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sd卡读写verilog

一般编程问题

下载此实例
  • 开发语言:Others
  • 实例大小:5.90M
  • 下载次数:5
  • 浏览次数:471
  • 发布时间:2020-09-04
  • 实例类别:一般编程问题
  • 发 布 人:robot666
  • 文件格式:.zip
  • 所需积分:2
 

实例介绍

【实例简介】
这是利用FPGA来读写SD卡的程序,是开源程序。
【实例截图】
【核心代码】
SD
└── SD
├── Aldec
│   └── design0
│   ├── design0.adf
│   ├── fsm.set
│   └── src
│   ├── initSD.asf
│   ├── readWriteSDBlock.asf
│   ├── readWriteSPIWireData.asf
│   ├── sendCmd.asf
│   └── spiCtrl.asf
├── bench
│   ├── testCase0.v
│   └── testHarness.v
├── doc
│   ├── spiMaster_FSM.pdf
│   ├── spiMaster_Specification.pdf
│   └── src
│   └── spiMaster_Specification.sxw
├── model
│   ├── sdModel.v
│   └── wb_master_model.v
├── RTL
│   ├── ctrlStsRegBI.v
│   ├── db
│   │   ├── altsyncram_mrc1.tdf
│   │   ├── altsyncram_peg1.tdf
│   │   ├── logic_util_heursitic.dat
│   │   ├── spiMaster.(0).cnf.cdb
│   │   ├── spiMaster.(0).cnf.hdb
│   │   ├── spiMaster.(10).cnf.cdb
│   │   ├── spiMaster.(10).cnf.hdb
│   │   ├── spiMaster.(11).cnf.cdb
│   │   ├── spiMaster.(11).cnf.hdb
│   │   ├── spiMaster.(12).cnf.cdb
│   │   ├── spiMaster.(12).cnf.hdb
│   │   ├── spiMaster.(13).cnf.cdb
│   │   ├── spiMaster.(13).cnf.hdb
│   │   ├── spiMaster.(14).cnf.cdb
│   │   ├── spiMaster.(14).cnf.hdb
│   │   ├── spiMaster.(15).cnf.cdb
│   │   ├── spiMaster.(15).cnf.hdb
│   │   ├── spiMaster.(16).cnf.cdb
│   │   ├── spiMaster.(16).cnf.hdb
│   │   ├── spiMaster.(17).cnf.cdb
│   │   ├── spiMaster.(17).cnf.hdb
│   │   ├── spiMaster.(1).cnf.cdb
│   │   ├── spiMaster.(1).cnf.hdb
│   │   ├── spiMaster.(2).cnf.cdb
│   │   ├── spiMaster.(2).cnf.hdb
│   │   ├── spiMaster.(3).cnf.cdb
│   │   ├── spiMaster.(3).cnf.hdb
│   │   ├── spiMaster.(4).cnf.cdb
│   │   ├── spiMaster.(4).cnf.hdb
│   │   ├── spiMaster.(5).cnf.cdb
│   │   ├── spiMaster.(5).cnf.hdb
│   │   ├── spiMaster.(6).cnf.cdb
│   │   ├── spiMaster.(6).cnf.hdb
│   │   ├── spiMaster.(7).cnf.cdb
│   │   ├── spiMaster.(7).cnf.hdb
│   │   ├── spiMaster.(8).cnf.cdb
│   │   ├── spiMaster.(8).cnf.hdb
│   │   ├── spiMaster.(9).cnf.cdb
│   │   ├── spiMaster.(9).cnf.hdb
│   │   ├── spiMaster.amm.cdb
│   │   ├── spiMaster.asm_labs.ddb
│   │   ├── spiMaster.asm.qmsg
│   │   ├── spiMaster.asm.rdb
│   │   ├── spiMaster.cbx.xml
│   │   ├── spiMaster.cmp0.ddb
│   │   ├── spiMaster.cmp1.ddb
│   │   ├── spiMaster.cmp2.ddb
│   │   ├── spiMaster.cmp.bpm
│   │   ├── spiMaster.cmp.cdb
│   │   ├── spiMaster.cmp.hdb
│   │   ├── spiMaster.cmp.kpt
│   │   ├── spiMaster.cmp.logdb
│   │   ├── spiMaster.cmp_merge.kpt
│   │   ├── spiMaster.cmp.rdb
│   │   ├── spiMaster.db_info
│   │   ├── spiMaster.eda.qmsg
│   │   ├── spiMaster.fit.qmsg
│   │   ├── spiMaster.hier_info
│   │   ├── spiMaster.hif
│   │   ├── spiMaster.idb.cdb
│   │   ├── spiMaster.lpc.html
│   │   ├── spiMaster.lpc.rdb
│   │   ├── spiMaster.lpc.txt
│   │   ├── spiMaster.map_bb.cdb
│   │   ├── spiMaster.map_bb.hdb
│   │   ├── spiMaster.map_bb.logdb
│   │   ├── spiMaster.map.bpm
│   │   ├── spiMaster.map.cdb
│   │   ├── spiMaster.map.hdb
│   │   ├── spiMaster.map.kpt
│   │   ├── spiMaster.map.logdb
│   │   ├── spiMaster.map.qmsg
│   │   ├── spiMaster.pre_map.cdb
│   │   ├── spiMaster.pre_map.hdb
│   │   ├── spiMaster.root_partition.map.reg_db.cdb
│   │   ├── spiMaster.rpp.qmsg
│   │   ├── spiMaster.rtlv.hdb
│   │   ├── spiMaster.rtlv_sg.cdb
│   │   ├── spiMaster.rtlv_sg_swap.cdb
│   │   ├── spiMaster.sgate.rvd
│   │   ├── spiMaster.sgate_sm.rvd
│   │   ├── spiMaster.sgdiff.cdb
│   │   ├── spiMaster.sgdiff.hdb
│   │   ├── spiMaster.sld_design_entry_dsc.sci
│   │   ├── spiMaster.sld_design_entry.sci
│   │   ├── spiMaster.smart_action.txt
│   │   ├── spiMaster.smp_dump.txt
│   │   ├── spiMaster.sta_cmp.8_slow.tdb
│   │   ├── spiMaster.sta.qmsg
│   │   ├── spiMaster.sta.rdb
│   │   ├── spiMaster.syn_hier_info
│   │   ├── spiMaster.tis_db_list.ddb
│   │   └── spiMaster.tmw_info
│   ├── incremental_db
│   │   ├── compiled_partitions
│   │   │   ├── spiMaster.db_info
│   │   │   ├── spiMaster.root_partition.cmp.cdb
│   │   │   ├── spiMaster.root_partition.cmp.dfp
│   │   │   ├── spiMaster.root_partition.cmp.hdb
│   │   │   ├── spiMaster.root_partition.cmp.kpt
│   │   │   ├── spiMaster.root_partition.cmp.logdb
│   │   │   ├── spiMaster.root_partition.cmp.rcfdb
│   │   │   ├── spiMaster.root_partition.map.cdb
│   │   │   ├── spiMaster.root_partition.map.dpi
│   │   │   ├── spiMaster.root_partition.map.hbdb.cdb
│   │   │   ├── spiMaster.root_partition.map.hbdb.hb_info
│   │   │   ├── spiMaster.root_partition.map.hbdb.hdb
│   │   │   ├── spiMaster.root_partition.map.hbdb.sig
│   │   │   ├── spiMaster.root_partition.map.hdb
│   │   │   └── spiMaster.root_partition.map.kpt
│   │   └── README
│   ├── initSD.v
│   ├── readWriteSDBlock.v
│   ├── readWriteSPIWireData.v
│   ├── sendCmd.v
│   ├── simulation
│   │   └── modelsim
│   │   ├── spiMaster_fast.vo
│   │   ├── spiMaster_modelsim.xrf
│   │   ├── spiMaster.sft
│   │   ├── spiMaster_v_fast.sdo
│   │   ├── spiMaster.vo
│   │   └── spiMaster_v.sdo
│   ├── sm_dpMem_dc.v
│   ├── sm_fifoRTL.v
│   ├── sm_RxFifoBI.v
│   ├── sm_RxFifo.v
│   ├── sm_TxFifoBI.v
│   ├── sm_TxFifo.v
│   ├── spiCtrl.v
│   ├── spiMaster.asm.rpt
│   ├── spiMaster_defines.v
│   ├── spiMaster.done
│   ├── spiMaster.eda.rpt
│   ├── spiMaster.fit.rpt
│   ├── spiMaster.fit.smsg
│   ├── spiMaster.fit.summary
│   ├── spiMaster.flow.rpt
│   ├── spiMaster.jdi
│   ├── spiMaster.map.rpt
│   ├── spiMaster.map.summary
│   ├── spiMaster.pin
│   ├── spiMaster.pof
│   ├── spiMaster.qpf
│   ├── spiMaster.qsf
│   ├── spiMaster.sof
│   ├── spiMaster.sta.rpt
│   ├── spiMaster.sta.summary
│   ├── spiMaster.v
│   ├── spiMasterWishBoneBI.v
│   ├── spiTxRxData.v
│   └── timescale.v
├── sim
│   ├── build_icarus.bat
│   ├── compile.do
│   ├── filelist.icarus
│   ├── modelsim.ini
│   ├── run.do
│   ├── run_icarus.bat
│   └── wave.do
└── syn
├── db
│   ├── spiMaster.db_info
│   └── spiMaster.sld_design_entry.sci
├── incremental_db
│   ├── compiled_partitions
│   │   └── spiMaster.db_info
│   └── README
├── spiMaster_assignment_defaults.qdf
├── spiMaster.qpf
├── spiMaster.qsf
├── spiMaster.qws
└── undo_redo.txt

19 directories, 179 files

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sd卡读写verilog

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