synopsys icc lab

【实例简介】
synopsys icc lab.
【实例截图】
【核心代码】
icc
└── icc
└── workshop
├── icc_200906_workshop.pdf
├── IC Compiler 2009_06 workshop(PDF)+LAB数据文件-应该是目前最新的ICC的WORKSHOP - 资料区 - 后端设计 - 中国电子顶级开发网论坛 国内最顶级的电子论坛，最活跃的电子工程师交流社区.files
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├── IC Compiler 2009_06 workshop(PDF)+LAB数据文件-应该是目前最新的ICC的WORKSHOP - 资料区 - 后端设计 - 中国电子顶级开发网论坛 国内最顶级的电子论坛，最活跃的电子工程师交流社区.htm
├── ICC-RM_C-2009.06-SP4
│   ├── common_setup.tcl
│   ├── icc_dp_scripts
│   │   ├── baseline.tcl
│   │   ├── commit_dp.tcl
│   │   ├── create_plangroups_dp.tcl
│   │   ├── create_va_dp.tcl
│   │   ├── explore.tcl
│   │   ├── feasibility_dp.tcl
│   │   ├── feasibility_on_plangroups_dp.tcl
│   │   ├── gen_explore_table
│   │   ├── gen_explore_table_for_parallel
│   │   ├── gen_explore_table.pl
│   │   ├── gui_save_snapshots.tcl
│   │   ├── pin_assignment_budgeting_dp.tcl
│   │   ├── prepare_block_dp.tcl
│   │   ├── prepare_parallel.csh
│   │   ├── prepare_parallel_feasibility.tcl
│   │   ├── prepare_parallel.pl
│   │   ├── prepare_parallel.README.txt
│   │   ├── prepare_parallel.tcl
│   │   └── proc_explore.tcl
│   ├── ICC-RMsettings.txt
│   ├── icc_scripts
│   │   ├── check_icc_rm_values.tcl
│   │   ├── chip_finish_icc.tcl
│   │   ├── clock_opt_cts_icc.tcl
│   │   ├── clock_opt_psyn_icc.tcl
│   │   ├── clock_opt_route_icc.tcl
│   │   ├── common_cts_settings_icc.tcl
│   │   ├── common_optimization_settings_icc.tcl
│   │   ├── common_placement_settings_icc.tcl
│   │   ├── common_post_cts_timing_settings.tcl
│   │   ├── common_route_si_settings_icc.tcl
│   │   ├── eco_icc.tcl
│   │   ├── init_design_icc.tcl
│   │   ├── insert_mv_filler_cells.tcl
│   │   ├── interclock_delay_options.tcl
│   │   ├── latency_adjustment_options.tcl
│   │   ├── mcmm.scenarios.example
│   │   ├── metal_fill_icc.tcl
│   │   ├── mv_pg_connect.tcl
│   │   ├── mv_setup_design.tcl
│   │   ├── outputs_icc.tcl
│   │   ├── place_opt_icc.tcl
│   │   ├── route_icc.tcl
│   │   ├── route_opt_icc.tcl
│   │   └── signoff_opt_icc.tcl
│   ├── icc_setup.tcl
│   ├── icc_zrt_scripts
│   │   ├── chip_finish_icc.tcl
│   │   ├── clock_opt_psyn_icc.tcl
│   │   ├── clock_opt_route_icc.tcl
│   │   ├── common_route_si_settings_zrt_icc.tcl
│   │   ├── eco_icc.tcl
│   │   ├── metal_fill_icc.tcl
│   │   ├── outputs_icc.tcl
│   │   ├── route_icc.tcl
│   │   ├── route_opt_icc.tcl
│   │   └── signoff_opt_icc.tcl
│   ├── Makefile
│   ├── Makefile_hier
│   ├── Makefile_zrt
│   ├── README.ICC-DP-RM.txt
│   ├── README.ICC-HRM.txt
│   ├── README.ICC-RM.txt
│   ├── Release_Notes.ICC-DP-RM.txt
│   ├── Release_Notes.ICC-HRM.txt
│   └── Release_Notes.ICC-RM.txt
├── lab0_gui00
│   ├── icc_output.txt
│   └── risc_chip.mw
│   ├── CEL
│   │   ├── placed_1
│   │   ├── placed_1_1
│   │   ├── placed_1_2
│   │   └── placed_1_6
│   ├── lib
│   ├── lib_1
│   └── lib_bck
├── lab1_data_setup00
│   ├── clock_opt.timing
│   ├── design_data
│   │   ├── RISC_CHIP.def
│   │   ├── RISC_CHIP.sdc
│   │   └── RISC_CHIP.v
│   ├── icc_output.txt
│   ├── net.acts
│   ├── place_opt.timing
│   ├── risc_chip.mw
│   │   ├── CEL
│   │   │   ├── RISC_CHIP_1
│   │   │   ├── RISC_CHIP_1_5
│   │   │   ├── RISC_CHIP_cts_1
│   │   │   ├── RISC_CHIP_cts_1_19
│   │   │   ├── RISC_CHIP_cts_1_20
│   │   │   ├── RISC_CHIP_cts_1_21
│   │   │   ├── RISC_CHIP_cts_1_22
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│   │   │   ├── RISC_CHIP_cts_1_25
│   │   │   ├── RISC_CHIP_cts_1_27
│   │   │   ├── RISC_CHIP_cts_1_5
│   │   │   ├── RISC_CHIP_data_setup_1
│   │   │   ├── RISC_CHIP_data_setup_1_4
│   │   │   ├── RISC_CHIP_floorplanned_1
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│   │   │   ├── RISC_CHIP_placed_1
│   │   │   ├── RISC_CHIP_placed_1_10
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│   │   │   ├── RISC_CHIP_placed_1_14
│   │   │   ├── RISC_CHIP_placed_1_15
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│   │   │   ├── RISC_CHIP_placed_1_18
│   │   │   └── RISC_CHIP_placed_1_5
│   │   ├── lib
│   │   ├── lib_1
│   │   └── lib_bck
│   ├── RISC_CHIP_port_map.0
│   ├── scripts
│   │   ├── derive_pg.tcl
│   │   ├── opt_ctrl.tcl
│   │   └── zic_timing.tcl
│   └── zic.timing
└── ref00
├── db
│   ├── io_max.db
│   ├── io_min.db
│   ├── ram16x128_max.db
│   ├── ram16x128_min.db
│   ├── ram32x64_max.db
│   ├── ram32x64_min.db
│   ├── ram4x32_max.db
│   ├── ram4x32_min.db
│   ├── ram8x64_max.db
│   ├── ram8x64_min.db
│   ├── sc_max.db
│   ├── sc_min.db
│   ├── sc_pg_max.db
│   ├── sc_pg_min.db
│   ├── special_max.db
│   └── special_min.db
├── design_data
│   ├── ORCA_TOP.ddc
│   ├── ORCA_TOP.def
│   ├── ORCA_TOP.fp
│   ├── ORCA_TOP_golden.sdc
│   ├── ORCA_TOP.scandef
│   ├── ORCA_TOP.sdc
│   ├── ORCA_TOP.v
│   ├── RISC_CHIP.def
│   ├── RISC_CHIP.sdc
│   ├── RISC_CHIP.tdf
│   └── RISC_CHIP.v
├── icc_settings.tcl
├── mw_lib
│   ├── io
│   │   ├── CEL
│   │   │   ├── pc3b01_1
│   │   │   ├── pc3b01d_1
│   │   │   ├── pc3b01u_1
│   │   │   ├── pc3b02_1
│   │   │   ├── pc3b02d_1
│   │   │   ├── pc3b02u_1
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│   │   │   ├── pc3b03d_1
│   │   │   ├── pc3b03u_1
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│   │   │   ├── pc3b04d_1
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│   │   │   ├── pc3c01_1
│   │   │   ├── pc3d00_1
│   │   │   ├── pc3d01_1
│   │   │   ├── pc3d01d_1
│   │   │   ├── pc3d01u_1
│   │   │   ├── pc3d10_1
│   │   │   ├── pc3d11_1
│   │   │   ├── pc3d11d_1
│   │   │   ├── pc3d11u_1
│   │   │   ├── pc3d21_1
│   │   │   ├── pc3d21d_1
│   │   │   ├── pc3d21u_1
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│   │   │   ├── pt3t01u_1
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│   │   │   ├── pt3t02u_1
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│   │   │   ├── pt3t03u_1
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