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verilog语言 秒表程序源代码及时序图

一般编程问题

下载此实例
  • 开发语言:Others
  • 实例大小:0.38M
  • 下载次数:3
  • 浏览次数:172
  • 发布时间:2020-07-31
  • 实例类别:一般编程问题
  • 发 布 人:robot666
  • 文件格式:.rar
  • 所需积分:2
 

实例介绍

【实例简介】
详细提供verilog语言编写的秒表源代码及时序仿真图
【实例截图】
【核心代码】
miaobiao
└── miaobiao
├── 1.vwf
├── bc.bsf
├── bc.v
├── db
│   ├── add_sub_3rh.tdf
│   ├── add_sub_4rh.tdf
│   ├── mux_hfc.tdf
│   ├── prev_cmp_test.asm.qmsg
│   ├── prev_cmp_test.fit.qmsg
│   ├── prev_cmp_test.map.qmsg
│   ├── prev_cmp_test.qmsg
│   ├── prev_cmp_test.sim.qmsg
│   ├── prev_cmp_test.tan.qmsg
│   ├── test.(0).cnf.cdb
│   ├── test.(0).cnf.hdb
│   ├── test.(1).cnf.cdb
│   ├── test.(1).cnf.hdb
│   ├── test.(2).cnf.cdb
│   ├── test.(2).cnf.hdb
│   ├── test.(3).cnf.cdb
│   ├── test.(3).cnf.hdb
│   ├── test.(4).cnf.cdb
│   ├── test.(4).cnf.hdb
│   ├── test.(5).cnf.cdb
│   ├── test.(5).cnf.hdb
│   ├── test.ace_cmp.bpm
│   ├── test.ace_cmp.cdb
│   ├── test.ace_cmp.ecobp
│   ├── test.ace_cmp.hdb
│   ├── test.asm.qmsg
│   ├── test.cbx.xml
│   ├── test.cmp0.ddb
│   ├── test.cmp.bpm
│   ├── test.cmp.cdb
│   ├── test.cmp.ecobp
│   ├── test.cmp.hdb
│   ├── test.cmp.kpt
│   ├── test.cmp.logdb
│   ├── test.cmp_merge.kpt
│   ├── test.cmp.rdb
│   ├── test.cmp.tdb
│   ├── test.db_info
│   ├── test.eco.cdb
│   ├── test.eds_overflow
│   ├── test.fit.qmsg
│   ├── test.fnsim.cdb
│   ├── test.fnsim.hdb
│   ├── test.fnsim.qmsg
│   ├── test_global_asgn_op.abo
│   ├── test.hier_info
│   ├── test.hif
│   ├── test.lpc.html
│   ├── test.lpc.rdb
│   ├── test.lpc.txt
│   ├── test.map_bb.cdb
│   ├── test.map_bb.hdb
│   ├── test.map_bb.logdb
│   ├── test.map.bpm
│   ├── test.map.cdb
│   ├── test.map.ecobp
│   ├── test.map.hdb
│   ├── test.map.kpt
│   ├── test.map.logdb
│   ├── test.map.qmsg
│   ├── test.pre_map.cdb
│   ├── test.pre_map.hdb
│   ├── test.rtlv.hdb
│   ├── test.rtlv_sg.cdb
│   ├── test.rtlv_sg_swap.cdb
│   ├── test.sgdiff.cdb
│   ├── test.sgdiff.hdb
│   ├── test.sim.cvwf
│   ├── test.sim.hdb
│   ├── test.sim.qmsg
│   ├── test.sim.rdb
│   ├── test.sld_design_entry_dsc.sci
│   ├── test.sld_design_entry.sci
│   ├── test.syn_hier_info
│   ├── test.tan.qmsg
│   ├── test.tis_db_list.ddb
│   ├── test.tmw_info
│   └── wed.wsf
├── fd10.bsf
├── fd10.v
├── fd10.v.bak
├── fp10.bdf
├── incremental_db
│   ├── compiled_partitions
│   │   ├── test.root_partition.cmp.atm
│   │   ├── test.root_partition.cmp.dfp
│   │   ├── test.root_partition.cmp.hdbx
│   │   ├── test.root_partition.cmp.kpt
│   │   ├── test.root_partition.cmp.logdb
│   │   ├── test.root_partition.cmp.rcf
│   │   ├── test.root_partition.map.atm
│   │   ├── test.root_partition.map.dpi
│   │   ├── test.root_partition.map.hdbx
│   │   └── test.root_partition.map.kpt
│   └── README
├── lt.bsf
├── lt.v
├── mul_one.bsf
├── Mul_one.v
├── Mul_one.v.bak
├── tc.bsf
├── tc.v
├── test.asm.rpt
├── test.bdf
├── test.done
├── test.fit.rpt
├── test.fit.smsg
├── test.fit.summary
├── test.flow.rpt
├── test.map.rpt
├── test.map.summary
├── test.pin
├── test.pof
├── test.qpf
├── test.qsf
├── test.qws
├── test.sim.rpt
├── test.sof
├── test.tan.rpt
├── test.tan.summary
├── test.vwf
├── Waveform4.vwf
└── Waveform6.vwf

4 directories, 124 files

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verilog语言 秒表程序源代码及时序图

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