Debussy 5.4V5

【实例简介】
亲测解压可用，没有 V9 版的装 Crack 和 缺失 DLL 的问题，看波形利器
【实例截图】
【核心代码】
4744302542890155175.zip
└── Novas
└── Debussy
├── bin
│   ├── AMBIT.pl
│   ├── Debussy.exe
│   ├── Debussy.exe.bak
│   ├── Debussy.exeLog
│   │   ├── compiler.log
│   │   ├── Debussy.exe.cmd
│   │   ├── Debussy.exe.cmd.bak
│   │   ├── debussy.rc
│   │   ├── ToNetlist.log
│   │   └── turbo.log
│   ├── debussy.rc
│   ├── edif2SymDB.exe
│   ├── EinsTimer.pl
│   ├── env.ini
│   ├── fsdb2vcd.exe
│   ├── fsdbdebug.exe
│   ├── fsdbextract.exe
│   ├── fsdbmerge.exe
│   ├── fsdbreport.exe
│   ├── gencom.exe
│   ├── IMAGEHLP.DLL
│   ├── libls.exe
│   ├── lmgrd.exe
│   ├── lmutil.exe
│   ├── magma.pl
│   ├── map2SymDB.exe
│   ├── nBridge.exe
│   ├── nce2report.exe
│   ├── nce2report.exe.bak
│   ├── nCompare.exe
│   ├── nCompare.exe.bak
│   ├── nCompare.exeLog
│   │   ├── nCompare.exe.cmd
│   │   ├── ncompare.rc
│   │   └── turbo.log
│   ├── netlistcom.exe
│   ├── netlistcom.exe.bak
│   ├── nWave.bat
│   ├── pearl.pl
│   ├── pt2Xml.pl
│   ├── sdfin.exe
│   ├── snslmgrd.exe
│   ├── snslmgrd.exe.bak
│   ├── symDB2map.exe
│   ├── syn2SymDB.exe
│   ├── turboDrv.dll
│   ├── vericom.exe
│   ├── vfast16.exe
│   ├── vfast.exe
│   ├── vfast.exeLog
│   │   └── turbo.log
│   ├── vhdlcom.exe
│   ├── vlmap.exe
│   └── xloc.exe
├── demo
│   ├── analog
│   │   ├── PowerMill.out
│   │   └── SmartSpice.out
│   ├── ldv_vhpi
│   │   ├── hdl
│   │   │   ├── verilog
│   │   │   │   ├── memory
│   │   │   │   │   ├── maprom.dat
│   │   │   │   │   ├── microrom.dat
│   │   │   │   │   └── pram.dat
│   │   │   │   ├── RTL
│   │   │   │   │   ├── ALUB.v
│   │   │   │   │   ├── alu.v
│   │   │   │   │   ├── CCU.v
│   │   │   │   │   ├── CPU.v
│   │   │   │   │   ├── PCU.v
│   │   │   │   │   └── TopModule.v
│   │   │   │   └── src
│   │   │   │   ├── cpu.alias
│   │   │   │   ├── maprom.v
│   │   │   │   ├── mem.v
│   │   │   │   ├── microrom.v
│   │   │   │   ├── pram.v
│   │   │   │   └── system.v
│   │   │   ├── Verilog_Top
│   │   │   │   ├── add4.vhd
│   │   │   │   ├── add_rtl.v
│   │   │   │   ├── add_sim.v
│   │   │   │   ├── cds.lib
│   │   │   │   ├── full_adder.v
│   │   │   │   ├── full_adder_wrap.vhd
│   │   │   │   ├── hdl.var
│   │   │   │   ├── Makefile
│   │   │   │   └── vcd_general_cmds
│   │   │   └── vhdl
│   │   │   ├── memory
│   │   │   │   ├── maprom.dat
│   │   │   │   ├── microrom.dat
│   │   │   │   └── pram.dat
│   │   │   ├── RTL
│   │   │   │   ├── ALUB.vhd
│   │   │   │   ├── arithlogic.vhd
│   │   │   │   ├── CCU.vhd
│   │   │   │   ├── cpu.alias
│   │   │   │   ├── CPU.vhd
│   │   │   │   └── PCU.vhd
│   │   │   └── src
│   │   │   ├── maprom.vhd
│   │   │   ├── microrom.vhd
│   │   │   ├── novas.vhd
│   │   │   ├── packageCPU.vhd
│   │   │   ├── pack.vhd
│   │   │   ├── pram.vhd
│   │   │   ├── pred_fns.vhd
│   │   │   └── system.vhd
│   │   ├── lib
│   │   │   ├── Debussy_PLI
│   │   │   ├── Makefile
│   │   │   ├── newcfc.c
│   │   │   ├── newfmi.c
│   │   │   ├── new_veriuser.c
│   │   │   └── User_Data
│   │   │   ├── Makefile
│   │   │   ├── user_app.c
│   │   │   ├── user_cfc.c
│   │   │   ├── user_fmi.c
│   │   │   ├── user_fmi.vhd
│   │   │   └── user_veriuser.c
│   │   ├── Makefile
│   │   ├── README
│   │   ├── SOURCEME
│   │   └── SOURCEME.example
│   ├── mixed
│   │   ├── COMPILE
│   │   ├── debussy.rc
│   │   ├── mixed.fsdb
│   │   ├── mixed.vcd
│   │   ├── RUN
│   │   ├── verilog
│   │   │   ├── ALUB.v
│   │   │   ├── CCU.v
│   │   │   ├── child1.v
│   │   │   ├── child2.v
│   │   │   ├── child3.v
│   │   │   ├── master.v
│   │   │   ├── memory
│   │   │   │   ├── maprom.dat
│   │   │   │   ├── microrom.dat
│   │   │   │   └── pram.dat
│   │   │   ├── mem.v
│   │   │   └── TopModule.v
│   │   └── vhdl
│   │   ├── arithlogic.vhd
│   │   ├── memory
│   │   │   ├── maprom.dat
│   │   │   ├── microrom.dat
│   │   │   └── pram.dat
│   │   ├── novas.vhd
│   │   ├── packageCPU.vhd
│   │   ├── PCU_record.vhd
│   │   ├── pram_mixed.vhd
│   │   ├── pred_fns.vhd
│   │   └── system_state.vhd
│   ├── nBench
│   │   └── Specman
│   │   ├── cpu_duv.e
│   │   ├── cpu_instr.e
│   │   ├── cpu_program.e
│   │   ├── cpu_ref.e
│   │   ├── cpu_top.e
│   │   ├── nBench.fsdb
│   │   ├── pram_duv.e
│   │   ├── pram_ref.e
│   │   ├── test_cpuref.e
│   │   └── test_genprogram.e
│   ├── nCompare
│   │   ├── nCmp_demo1
│   │   │   ├── demo_Gate_verilog.fsdb
│   │   │   ├── demo.ncr
│   │   │   ├── demo_RTL_verilog.fsdb
│   │   │   ├── diff1.fsdb
│   │   │   └── diff2.fsdb
│   │   └── nCmp_demo2
│   │   ├── case1.nce
│   │   ├── case1.ncr
│   │   ├── design
│   │   │   ├── Gate
│   │   │   │   ├── CPU.vg
│   │   │   │   ├── lib.lib++
│   │   │   │   │   ├── libfile
│   │   │   │   │   ├── _sarch.0
│   │   │   │   │   └── techfile
│   │   │   │   ├── lib.v
│   │   │   │   ├── ori.fsdb
│   │   │   │   ├── pat101.fsdb
│   │   │   │   ├── run.f
│   │   │   │   ├── SDF
│   │   │   │   │   └── presim.sdf
│   │   │   │   └── system.v
│   │   │   ├── memory
│   │   │   │   ├── maprom.dat
│   │   │   │   ├── microrom.dat
│   │   │   │   └── pram.dat
│   │   │   ├── RTL
│   │   │   │   ├── ALUB.v
│   │   │   │   ├── alu.v
│   │   │   │   ├── CCU.v
│   │   │   │   ├── ori.fsdb
│   │   │   │   ├── pat101.fsdb
│   │   │   │   ├── PCU.v
│   │   │   │   ├── run.f
│   │   │   │   ├── system.v
│   │   │   │   ├── TopModule.v
│   │   │   │   ├── verilog.fsdb
│   │   │   │   └── verilog.log
│   │   │   └── src
│   │   │   ├── mem.v
│   │   │   └── pram.v
│   │   ├── Gold
│   │   │   ├── pat101.fsdb
│   │   │   └── pat102.fsdb
│   │   └── Test
│   │   ├── pat101.fsdb
│   │   └── pat102.fsdb
│   ├── nECO
│   │   ├── demo
│   │   │   ├── gate
│   │   │   │   ├── CPU.vg
│   │   │   │   ├── lib.v
│   │   │   │   ├── run.f
│   │   │   │   └── spare.list
│   │   │   ├── memory
│   │   │   │   ├── maprom.dat
│   │   │   │   ├── microrom.dat
│   │   │   │   └── pram.dat
│   │   │   └── src
│   │   │   ├── maprom.v
│   │   │   ├── mem.v
│   │   │   ├── microrom.v
│   │   │   ├── pram.v
│   │   │   └── system.v
│   │   └── tutorial
│   │   ├── gate
│   │   │   ├── cpu.alias
│   │   │   ├── CPU.vg
│   │   │   ├── lib.v
│   │   │   └── run.f
│   │   ├── memory
│   │   │   ├── maprom.dat
│   │   │   ├── microrom.dat
│   │   │   └── pram.dat
│   │   └── src
│   │   ├── maprom.v
│   │   ├── mem.v
│   │   ├── microrom.v
│   │   ├── pram.v
│   │   └── system.v
│   ├── pli
│   │   ├── MTI
│   │   │   ├── mixed
│   │   │   │   ├── README
│   │   │   │   ├── sim
│   │   │   │   │   ├── modelsim.ini
│   │   │   │   │   ├── run_mti_hppa.cmd
│   │   │   │   │   ├── run_mti_sol2.cmd
│   │   │   │   │   ├── run_verilog.f
│   │   │   │   │   ├── run_vhdl.f
│   │   │   │   │   └── stop.do
│   │   │   │   ├── verilog
│   │   │   │   │   ├── FSM
│   │   │   │   │   │   ├── child1.v
│   │   │   │   │   │   ├── child2.v
│   │   │   │   │   │   ├── child3.v
│   │   │   │   │   │   └── master.v
│   │   │   │   │   ├── memory
│   │   │   │   │   │   ├── maprom.dat
│   │   │   │   │   │   ├── microrom.dat
│   │   │   │   │   │   └── pram.dat
│   │   │   │   │   ├── RTL
│   │   │   │   │   │   ├── ALUB.v
│   │   │   │   │   │   ├── CCU.v
│   │   │   │   │   │   └── TopModule.v
│   │   │   │   │   └── src
│   │   │   │   │   └── mem.v
│   │   │   │   └── vhdl
│   │   │   │   ├── memory
│   │   │   │   │   ├── maprom.dat
│   │   │   │   │   ├── microrom.dat
│   │   │   │   │   └── pram.dat
│   │   │   │   ├── RTL
│   │   │   │   │   ├── arithlogic.vhd
│   │   │   │   │   └── PCU_record.vhd
│   │   │   │   └── src
│   │   │   │   ├── novas_hp.vhd
│   │   │   │   ├── novas.vhd
│   │   │   │   ├── packageCPU.vhd
│   │   │   │   ├── pram_mixed_vcd.vhd
│   │   │   │   ├── pram_mixed.vhd
│   │   │   │   ├── pred_fns.vhd
│   │   │   │   └── system_state.vhd
│   │   │   ├── verilog
│   │   │   │   ├── design
│   │   │   │   │   ├── ALUB.v
│   │   │   │   │   ├── alu.v
│   │   │   │   │   ├── CCU.v
│   │   │   │   │   ├── PCU.v
│   │   │   │   │   └── TopModule.v
│   │   │   │   ├── memory
│   │   │   │   │   ├── maprom.dat
│   │   │   │   │   ├── microrom.dat
│   │   │   │   │   └── pram.dat
│   │   │   │   ├── README
│   │   │   │   ├── sim
│   │   │   │   │   ├── modelsim_hppa.ini
│   │   │   │   │   ├── modelsim.ini
│   │   │   │   │   ├── modelsim_sol2.ini
│   │   │   │   │   ├── mti.do
│   │   │   │   │   ├── run.f
│   │   │   │   │   ├── run_mti_verilog_hppa.cmd
│   │   │   │   │   └── run_mti_verilog_sol2.cmd
│   │   │   │   └── src
│   │   │   │   ├── cpu.alias
│   │   │   │   ├── maprom.v
│   │   │   │   ├── mem.v
│   │   │   │   ├── microrom.v
│   │   │   │   ├── pram.v
│   │   │   │   └── system.v
│   │   │   └── vhdl
│   │   │   ├── design
│   │   │   │   ├── ALUB.vhd
│   │   │   │   ├── arithlogic.vhd
│   │   │   │   ├── CCU_lf.vhd
│   │   │   │   ├── CCU.vhd
│   │   │   │   ├── CPU.vhd
│   │   │   │   └── PCU.vhd
│   │   │   ├── memory
│   │   │   │   ├── maprom.dat
│   │   │   │   ├── microrom.dat
│   │   │   │   └── pram.dat
│   │   │   ├── README
│   │   │   ├── sim
│   │   │   │   ├── modelsim.ini
│   │   │   │   ├── run.f
│   │   │   │   ├── run_mti_hppa.cmd
│   │   │   │   ├── run_mti_sol2.cmd
│   │   │   │   └── stop.do
│   │   │   └── src
│   │   │   ├── maprom.vhd
│   │   │   ├── microrom.vhd
│   │   │   ├── novas_hp.vhd
│   │   │   ├── novas.vhd
│   │   │   ├── packageCPU.vhd
│   │   │   ├── pack.vhd
│   │   │   ├── pram.vhd
│   │   │   ├── pred_fns.vhd
│   │   │   └── system.vhd
│   │   ├── NC
│   │   │   ├── mixed
│   │   │   │   ├── ncshell_src
│   │   │   │   │   ├── arithlogic.vs
│   │   │   │   │   ├── CPU.vhd
│   │   │   │   │   ├── fsm_child1.vhd
│   │   │   │   │   ├── fsm_child2.vhd
│   │   │   │   │   ├── fsm_child3.vhd
│   │   │   │   │   ├── fsm_master.vhd
│   │   │   │   │   └── pcu.vs
│   │   │   │   ├── README
│   │   │   │   ├── sim
│   │   │   │   │   ├── cds.lib
│   │   │   │   │   ├── hdl.var
│   │   │   │   │   ├── run_nc_hppa.cmd
│   │   │   │   │   ├── run_nc_linux.cmd
│   │   │   │   │   ├── run_nc_sol2.cmd
│   │   │   │   │   ├── run_verilog.f
│   │   │   │   │   ├── run_vhdl.f
│   │   │   │   │   ├── run_vhdl_hp.f
│   │   │   │   │   ├── stop.do
│   │   │   │   │   └── stop_vcd_verilog_only.do
│   │   │   │   ├── verilog
│   │   │   │   │   ├── FSM
│   │   │   │   │   │   ├── child1.v
│   │   │   │   │   │   ├── child2.v
│   │   │   │   │   │   ├── child3.v
│   │   │   │   │   │   └── master.v
│   │   │   │   │   ├── memory
│   │   │   │   │   │   ├── maprom.dat
│   │   │   │   │   │   ├── microrom.dat
│   │   │   │   │   │   └── pram.dat
│   │   │   │   │   ├── RTL
│   │   │   │   │   │   ├── ALUB.v
│   │   │   │   │   │   ├── CCU.v
│   │   │   │   │   │   └── TopModule.v
│   │   │   │   │   └── src
│   │   │   │   │   └── mem.v
│   │   │   │   └── vhdl
│   │   │   │   ├── memory
│   │   │   │   │   ├── maprom.dat
│   │   │   │   │   ├── microrom.dat
│   │   │   │   │   └── pram.dat
│   │   │   │   ├── RTL
│   │   │   │   │   ├── arithlogic.vhd
│   │   │   │   │   └── PCU_record.vhd
│   │   │   │   └── src
│   │   │   │   ├── novas_hp.vhd
│   │   │   │   ├── novas.vhd
│   │   │   │   ├── packageCPU.vhd
│   │   │   │   ├── pram.vhd
│   │   │   │   ├── pred_fns.vhd
│   │   │   │   └── system_state.vhd
│   │   │   ├── verilog
│   │   │   │   ├── design
│   │   │   │   │   ├── ALUB.v
│   │   │   │   │   ├── alu.v
│   │   │   │   │   ├── CCU.v
│   │   │   │   │   ├── PCU.v
│   │   │   │   │   └── TopModule.v
│   │   │   │   ├── memory
│   │   │   │   │   ├── maprom.dat
│   │   │   │   │   ├── microrom.dat
│   │   │   │   │   └── pram.dat
│   │   │   │   ├── README
│   │   │   │   ├── sim
│   │   │   │   │   ├── cds.lib
│   │   │   │   │   ├── hdl.var
│   │   │   │   │   ├── Makefile.dyn.sun4v
│   │   │   │   │   ├── Makefile.hppa
│   │   │   │   │   ├── Makefile.nc.defines
│   │   │   │   │   ├── Makefile.nc.dyn.sun4v
│   │   │   │   │   ├── Makefile.nc.hppa
│   │   │   │   │   ├── Makefile.nc.sta.sun4v
│   │   │   │   │   ├── Makefile.nc.sun4v
│   │   │   │   │   ├── Makefile.nc.targets
│   │   │   │   │   ├── Makefile.nc.targets.mod
│   │   │   │   │   ├── Makefile.sta.sun4v
│   │   │   │   │   ├── Makefile.sun4v
│   │   │   │   │   ├── run.f
│   │   │   │   │   ├── RUN_NC.mod
│   │   │   │   │   ├── run_nc_vlg_dyn_hppa.cmd
│   │   │   │   │   ├── run_nc_vlg_dyn_sol2.cmd
│   │   │   │   │   ├── run_nc_vlg_sta_hppa.cmd
│   │   │   │   │   └── run_nc_vlg_sta_sol2.cmd
│   │   │   │   └── src
│   │   │   │   ├── cpu.alias
│   │   │   │   ├── maprom.v
│   │   │   │   ├── mem.v
│   │   │   │   ├── microrom.v
│   │   │   │   ├── pram.v
│   │   │   │   └── system.v
│   │   │   └── vhdl
│   │   │   ├── design
│   │   │   │   ├── ALUB.vhd
│   │   │   │   ├── arithlogic.vhd
│   │   │   │   ├── CCU_lf.vhd
│   │   │   │   ├── CCU.vhd
│   │   │   │   ├── CPU.vhd
│   │   │   │   ├── PCU_record.vhd
│   │   │   │   └── PCU.vhd
│   │   │   ├── memory
│   │   │   │   ├── maprom.dat
│   │   │   │   ├── microrom.dat
│   │   │   │   └── pram.dat
│   │   │   ├── README
│   │   │   ├── sim
│   │   │   │   ├── cds.lib
│   │   │   │   ├── hdl.var
│   │   │   │   ├── run.f
│   │   │   │   ├── run_hp.f
│   │   │   │   ├── run_ncvhdl_hppa.cmd
│   │   │   │   ├── run_ncvhdl_sol2.cmd
│   │   │   │   ├── stop.do
│   │   │   │   └── stop_vcd.do
│   │   │   └── src
│   │   │   ├── maprom.vhd
│   │   │   ├── microrom.vhd
│   │   │   ├── novas_hp.vhd
│   │   │   ├── novas.vhd
│   │   │   ├── packageCPU.vhd
│   │   │   ├── pack.vhd
│   │   │   ├── pram.vhd
│   │   │   ├── pred_fns.vhd
│   │   │   └── system.vhd
│   │   ├── snps_mixed
│   │   │   ├── verilog_top
│   │   │   │   ├── debussy.rc
│   │   │   │   ├── run_scs_mixed_sol2.cmd
│   │   │   │   ├── run_verilog.f
│   │   │   │   ├── run_vhdl.f
│   │   │   │   ├── scs_mixed.fsdb
│   │   │   │   ├── scs_mixed.vcd
│   │   │   │   ├── sim_fsdb.do
│   │   │   │   ├── sim_vcd.do
│   │   │   │   ├── synopsys_sim.setup
│   │   │   │   ├── verilog
│   │   │   │   │   ├── ALUB.v
│   │   │   │   │   ├── CCU.v
│   │   │   │   │   ├── child1.v
│   │   │   │   │   ├── child2.v
│   │   │   │   │   ├── child3.v
│   │   │   │   │   ├── master.v
│   │   │   │   │   ├── memory
│   │   │   │   │   │   ├── maprom.dat
│   │   │   │   │   │   ├── microrom.dat
│   │   │   │   │   │   └── pram.dat
│   │   │   │   │   ├── mem.v
│   │   │   │   │   ├── TopModule.v
│   │   │   │   │   └── top.v
│   │   │   │   └── vhdl
│   │   │   │   ├── arithlogic.vhd
│   │   │   │   ├── memory
│   │   │   │   │   ├── maprom.dat
│   │   │   │   │   ├── microrom.dat
│   │   │   │   │   └── pram.dat
│   │   │   │   ├── novas_old.vhd
│   │   │   │   ├── novas.vhd
│   │   │   │   ├── packageCPU.vhd
│   │   │   │   ├── PCU_record.vhd
│   │   │   │   ├── pram_mixed.vhd
│   │   │   │   ├── pred_fns.vhd
│   │   │   │   ├── system_state_scirocco.vhd
│   │   │   │   └── system_state.vhd
│   │   │   └── vhdl_top
│   │   │   ├── debussy.rc
│   │   │   ├── run_scs_mixed_sol2.cmd
│   │   │   ├── run_verilog.f
│   │   │   ├── run_vhdl.f
│   │   │   ├── scs_mixed.fsdb
│   │   │   ├── scs_mixed.vcd
│   │   │   ├── sim.do
│   │   │   ├── sim_vcd.do
│   │   │   ├── synopsys_sim.setup
│   │   │   ├── verilog
│   │   │   │   ├── ALUB.v
│   │   │   │   ├── CCU.v
│   │   │   │   ├── child1.v
│   │   │   │   ├── child2.v
│   │   │   │   ├── child3.v
│   │   │   │   ├── master.v
│   │   │   │   ├── memory
│   │   │   │   │   ├── maprom.dat
│   │   │   │   │   ├── microrom.dat
│   │   │   │   │   └── pram.dat
│   │   │   │   ├── mem.v
│   │   │   │   └── TopModule.v
│   │   │   └── vhdl
│   │   │   ├── arithlogic.vhd
│   │   │   ├── memory
│   │   │   │   ├── maprom.dat
│   │   │   │   ├── microrom.dat
│   │   │   │   └── pram.dat
│   │   │   ├── novas_old.vhd
│   │   │   ├── novas.vhd
│   │   │   ├── packageCPU.vhd
│   │   │   ├── PCU_record.vhd
│   │   │   ├── pram_mixed.vhd
│   │   │   ├── pred_fns.vhd
│   │   │   ├── system_state_scirocco.vhd
│   │   │   └── system_state.vhd
│   │   ├── specman
│   │   ├── VCS
│   │   │   ├── design
│   │   │   │   ├── ALUB.v
│   │   │   │   ├── alu.v
│   │   │   │   ├── CCU.v
│   │   │   │   ├── PCU.v
│   │   │   │   └── TopModule.v
│   │   │   ├── memory
│   │   │   │   ├── maprom.dat
│   │   │   │   ├── microrom.dat
│   │   │   │   └── pram.dat
│   │   │   ├── README
│   │   │   ├── sim
│   │   │   │   ├── run.f
│   │   │   │   ├── run_vcsd_hppa.cmd
│   │   │   │   ├── run_vcsd_sol2.cmd
│   │   │   │   ├── run_vcs_hppa.cmd
│   │   │   │   └── run_vcs_sol2.cmd
│   │   │   └── src
│   │   │   ├── cpu.alias
│   │   │   ├── maprom.v
│   │   │   ├── mem.v
│   │   │   ├── microrom.v
│   │   │   ├── pram.v
│   │   │   └── system.v
│   │   └── XL
│   │   ├── design
│   │   │   ├── ALUB.v
│   │   │   ├── alu.v
│   │   │   ├── CCU.v
│   │   │   ├── PCU.v
│   │   │   └── TopModule.v
│   │   ├── memory
│   │   │   ├── maprom.dat
│   │   │   ├── microrom.dat
│   │   │   └── pram.dat
│   │   ├── README
│   │   ├── sim
│   │   │   ├── cr_vlog_hppa_dym.mod
│   │   │   ├── cr_vlog_hppa_sta.mod
│   │   │   ├── cr_vlog_ibm_dym.mod
│   │   │   ├── cr_vlog_ibm_sta.mod
│   │   │   ├── cr_vlog_sol2_dym.mod
│   │   │   ├── cr_vlog_sol2_sta.mod
│   │   │   ├── run.f
│   │   │   ├── run_xl_dym_hppa.cmd
│   │   │   ├── run_xl_dym_ibm.cmd
│   │   │   ├── run_xl_dym_sol2.cmd
│   │   │   ├── run_xl_sta_hppa.cmd
│   │   │   ├── run_xl_sta_ibm.cmd
│   │   │   └── run_xl_sta_sol2.cmd
│   │   └── src
│   │   ├── cpu.alias
│   │   ├── maprom.v
│   │   ├── mem.v
│   │   ├── microrom.v
│   │   ├── pram.v
│   │   └── system.v
│   ├── Reusner
│   │   └── usb_demo
│   │   ├── bench
│   │   │   ├── generic_spram.v
│   │   │   ├── ssram.v
│   │   │   ├── system.v
│   │   │   ├── testbench.v
│   │   │   ├── tests_lib_display.v
│   │   │   ├── tests_lib.v
│   │   │   ├── tests.v
│   │   │   ├── timescale.v
│   │   │   ├── wb_master.v
│   │   │   ├── wb_mast_model.v
│   │   │   └── wb_model_defines.v
│   │   ├── doc
│   │   │   ├── README.txt
│   │   │   ├── STATUS.txt
│   │   │   ├── usb_appB.pdf
│   │   │   ├── usb_appC.pdf
│   │   │   ├── usb_ch2.pdf
│   │   │   ├── usb_ch4.pdf
│   │   │   └── usb_doc.pdf
│   │   ├── rtl
│   │   │   ├── usbf_crc16.v
│   │   │   ├── usbf_crc5.v
│   │   │   ├── usbf_defines.v
│   │   │   ├── usbf_ep_rf_dummy.v
│   │   │   ├── usbf_ep_rf.v
│   │   │   ├── usbf_idma.v
│   │   │   ├── usbf_mem_arb.v
│   │   │   ├── usbf_pa_demo.v
│   │   │   ├── usbf_pa.v
│   │   │   ├── usbf_pd_demo.v
│   │   │   ├── usbf_pd.v
│   │   │   ├── usbf_pe.v
│   │   │   ├── usbf_pl.v
│   │   │   ├── usbf_rf.v
│   │   │   ├── usbf_top.org
│   │   │   ├── usbf_top.v
│   │   │   ├── usbf_top.v.bak
│   │   │   ├── usbf_utmi_if.v
│   │   │   ├── usbf_utmi_ls.v
│   │   │   └── usbf_wb.v
│   │   └── sim
│   │   ├── databus.rc
│   │   ├── debussy.rc
│   │   ├── debussy.rc.demo
│   │   ├── RENEW
│   │   ├── run.f
│   │   ├── USB.Book++
│   │   │   ├── 00index.Book++
│   │   │   ├── Architecture
│   │   │   │   ├── TOP.sch
│   │   │   │   └── USB_CORE
│   │   │   │   ├── USBF_MEM_ARB
│   │   │   │   │   └── FullHierarchy.sch
│   │   │   │   ├── USBF_RF
│   │   │   │   ├── USBF_TOP.sch
│   │   │   │   ├── USBF_WB
│   │   │   │   │   └── FullHierarchy.sch
│   │   │   │   └── USB_PL
│   │   │   │   ├── DataPacket.sch
│   │   │   │   ├── FullHierarchy.sch
│   │   │   │   ├── TokenPacket.sch
│   │   │   │   ├── USBF_IDMA
│   │   │   │   │   ├── FullHierarchy.sch
│   │   │   │   │   ├── usbf_idma_rx_logic.sch
│   │   │   │   │   ├── usbf_idma_tx_logic.sch
│   │   │   │   │   └── usb_idma_fsm.fsm
│   │   │   │   ├── USBF_PA
│   │   │   │   │   └── FullHierarchy.sch
│   │   │   │   ├── USBF_PD
│   │   │   │   │   ├── DATA_PACKET_BYTES.sch
│   │   │   │   │   ├── FullHierachy.sch
│   │   │   │   │   ├── PID_DECODE.sch
│   │   │   │   │   └── TOKEN_PACKET_BYTES.sch
│   │   │   │   └── USBF_PE
│   │   │   ├── Datapath
│   │   │   │   ├── dataBus.sch
│   │   │   │   └── dataFlow
│   │   │   │   ├── memoryRead.sch
│   │   │   │   ├── memoryWrite.sch
│   │   │   │   ├── receiveDataPacket.sch
│   │   │   │   ├── registerConfig.sch
│   │   │   │   └── transmitDataPacket.sch
│   │   │   ├── detailLogics
│   │   │   │   ├── rx_data_valid.sch
│   │   │   │   └── tx_valid_last.sch
│   │   │   └── Operations
│   │   │   ├── BulkTrans
│   │   │   ├── ControlTrans
│   │   │   ├── InterruptTrans
│   │   │   └── IsochronousTrans
│   │   └── verilog.fsdb
│   ├── systemC
│   │   ├── osci
│   │   │   ├── ALUB.cpp
│   │   │   ├── ALUB.h
│   │   │   ├── alu.cpp
│   │   │   ├── alu.h
│   │   │   ├── base.h
│   │   │   ├── CCU.cpp
│   │   │   ├── CCU.h
│   │   │   ├── Makefile
│   │   │   ├── maprom.dat
│   │   │   ├── mem.cpp
│   │   │   ├── mem.h
│   │   │   ├── microrom.dat
│   │   │   ├── PCU.cpp
│   │   │   ├── PCU.h
│   │   │   ├── pram.cpp
│   │   │   ├── pram.dat
│   │   │   ├── pram.h
│   │   │   ├── README
│   │   │   ├── sourceMe
│   │   │   ├── system.cpp
│   │   │   ├── TopModule.cpp
│   │   │   └── TopModule.h
│   │   └── scv
│   │   ├── main.cpp
│   │   ├── Makefile
│   │   ├── Makefile.rules
│   │   ├── README
│   │   └── sourceMe
│   ├── SystemVerilog
│   │   ├── ALUB.v
│   │   ├── CCU.v
│   │   ├── child1.v
│   │   ├── child2.v
│   │   ├── child3.v
│   │   ├── demo.cmd
│   │   ├── master.v
│   │   ├── mem.v
│   │   ├── PCU.v
│   │   ├── pram.v
│   │   ├── run.f
│   │   ├── sv.fsdb
│   │   ├── system.v
│   │   └── TopModule.v
│   ├── verilog
│   │   ├── behav
│   │   │   ├── behav.fsdb
│   │   │   ├── behav.vcd
│   │   │   ├── cpu.alias
│   │   │   ├── cpu.v
│   │   │   ├── pram.v
│   │   │   ├── run.f
│   │   │   └── system.v
│   │   ├── gate
│   │   │   ├── cpu.alias
│   │   │   ├── CPU.sdf
│   │   │   ├── CPU.vg
│   │   │   ├── gate.evcd
│   │   │   ├── gate.fsdb
│   │   │   ├── gate.vcd
│   │   │   ├── lib.v
│   │   │   ├── mem.v
│   │   │   ├── pram.v
│   │   │   ├── README
│   │   │   ├── run.f
│   │   │   ├── sdc_system.sdc
│   │   │   ├── signal_group.rul
│   │   │   ├── system.v
│   │   │   ├── violate_path.rpt
│   │   │   └── violate_path.xml
│   │   ├── memory
│   │   │   ├── maprom.dat
│   │   │   ├── microrom.dat
│   │   │   └── pram.dat
│   │   └── rtl
│   │   ├── ALUB.v
│   │   ├── alu_module.psl
│   │   ├── alu.v
│   │   ├── arithlogic.psl
│   │   ├── bitwise.psl
│   │   ├── CCU.v
│   │   ├── child1.v
│   │   ├── child2.v
│   │   ├── child3.v
│   │   ├── cpu.alias
│   │   ├── demo.ova
│   │   ├── demo.register
│   │   ├── dump_on_off.fsdb
│   │   ├── master.v
│   │   ├── mem.v
│   │   ├── PCU.v
│   │   ├── pram.v
│   │   ├── psl.fsdb
│   │   ├── rtl.evcd
│   │   ├── rtl.fsdb
│   │   ├── rtl_ova.fsdb
│   │   ├── rtl.vcd
│   │   ├── run.f
│   │   ├── system.v
│   │   └── TopModule.v
│   └── vhdl
│   ├── fsm
│   │   ├── child1.vhd
│   │   ├── child2.vhd
│   │   ├── child3.vhd
│   │   ├── debussy.rc
│   │   ├── fsm.fsdb
│   │   ├── fsm.vcd
│   │   ├── master.vhd
│   │   ├── novas.vhd
│   │   ├── RUN
│   │   ├── run.f
│   │   └── system.vhd
│   ├── gate
│   │   ├── cpu.alias
│   │   ├── CPUg.vhd
│   │   ├── debussy.rc
│   │   ├── gate.fsdb
│   │   ├── gate.vcd
│   │   ├── lib.vital
│   │   ├── maprom.vhd
│   │   ├── microrom.vhd
│   │   ├── novas.vhd
│   │   ├── packageCPU.vhd
│   │   ├── pack.vhd
│   │   ├── pram.vhd
│   │   ├── pred_fns.vhd
│   │   ├── RUN
│   │   ├── run.f
│   │   ├── system.vhd
│   │   └── tsmc773_l.lib++
│   │   ├── libfile
│   │   ├── libfile.1-
│   │   ├── _sarch.0
│   │   ├── _sarch.1
│   │   ├── _sarch.2
│   │   ├── _sarch.3
│   │   ├── _sarch.4
│   │   ├── _sarch.5
│   │   ├── _sarch.6
│   │   ├── _sarch.7
│   │   └── techfile
│   ├── memory
│   │   ├── maprom.dat
│   │   ├── microrom.dat
│   │   └── pram.dat
│   └── rtl
│   ├── ALUB.vhd
│   ├── arithlogic.vhd
│   ├── CCU.vhd
│   ├── cpu.alias
│   ├── CPU.vhd
│   ├── debussy.rc
│   ├── maprom.vhd
│   ├── microrom.vhd
│   ├── novas.vhd
│   ├── packageCPU.vhd
│   ├── pack.vhd
│   ├── PCU.vhd
│   ├── pram.vhd
│   ├── pred_fns.vhd
│   ├── rtl.fsdb
│   ├── rtl.vcd
│   ├── RUN
│   ├── run.f
│   └── system.vhd
├── doc
│   ├── installation.pdf
│   ├── linking.pdf
│   ├── nCompare.pdf
│   ├── nECO.pdf
│   ├── notes
│   │   ├── 54_Limitations_KP.pdf
│   │   ├── 54_Releasenote.pdf
│   │   └── fixed_prob_54v5.pdf
│   ├── openkdb.pdf
│   ├── q_ref.pdf
│   ├── reference.pdf
│   ├── Reusner.pdf
│   ├── sync_template.pdf
│   ├── tutorial.pdf
│   └── verilog_example_for_openkdb.tar.gz
├── etc
│   ├── access
│   │   ├── access.res
│   │   ├── access.res.qds
│   │   ├── AceTk
│   │   ├── anoTool.fm
│   │   ├── associate.fm
│   │   ├── au.fm
│   │   ├── Big5.tbl
│   │   ├── bindkey.fm
│   │   ├── BWidget
│   │   │   ├── aclocal.m4
│   │   │   ├── arrow.tcl
│   │   │   ├── bitmap.tcl
│   │   │   ├── buttonbox.tcl
│   │   │   ├── button.tcl
│   │   │   ├── BWman
│   │   │   │   ├── ArrowButton.html
│   │   │   │   ├── ButtonBox.html
│   │   │   │   ├── Button.html
│   │   │   │   ├── BWidget.html
│   │   │   │   ├── ComboBox.html
│   │   │   │   ├── contents.html
│   │   │   │   ├── Dialog.html
│   │   │   │   ├── DragSite.html
│   │   │   │   ├── DropSite.html
│   │   │   │   ├── DynamicHelp.html
│   │   │   │   ├── Entry.html
│   │   │   │   ├── index.html
│   │   │   │   ├── LabelEntry.html
│   │   │   │   ├── LabelFrame.html
│   │   │   │   ├── Label.html
│   │   │   │   ├── ListBox.html
│   │   │   │   ├── MainFrame.html
│   │   │   │   ├── MessageDlg.html
│   │   │   │   ├── navtree.html
│   │   │   │   ├── NoteBook.html
│   │   │   │   ├── options.htm
│   │   │   │   ├── PagesManager.html
│   │   │   │   ├── PanedWindow.html
│   │   │   │   ├── PasswdDlg.html
│   │   │   │   ├── ProgressBar.html
│   │   │   │   ├── ProgressDlg.html
│   │   │   │   ├── ScrollableFrame.html
│   │   │   │   ├── ScrolledWindow.html
│   │   │   │   ├── ScrollView.html
│   │   │   │   ├── SelectColor.html
│   │   │   │   ├── SelectFont.html
│   │   │   │   ├── Separator.html
│   │   │   │   ├── SpinBox.html
│   │   │   │   ├── TitleFrame.html
│   │   │   │   ├── Tree.html
│   │   │   │   └── Widget.html
│   │   │   ├── ChangeLog
│   │   │   ├── CHANGES.txt
│   │   │   ├── color.tcl
│   │   │   ├── combobox.tcl
│   │   │   ├── configure.in
│   │   │   ├── demo
│   │   │   │   ├── basic.tcl
│   │   │   │   ├── bwidget.xbm
│   │   │   │   ├── demo.tcl
│   │   │   │   ├── dnd.tcl
│   │   │   │   ├── manager.tcl
│   │   │   │   ├── select.tcl
│   │   │   │   ├── tmpldlg.tcl
│   │   │   │   ├── tree.tcl
│   │   │   │   └── x1.xbm
│   │   │   ├── dialog.tcl
│   │   │   ├── dragsite.tcl
│   │   │   ├── dropsite.tcl
│   │   │   ├── dynhelp.tcl
│   │   │   ├── entry.tcl
│   │   │   ├── font.tcl
│   │   │   ├── images
│   │   │   │   ├── bold.gif
│   │   │   │   ├── copy.gif
│   │   │   │   ├── cut.gif
│   │   │   │   ├── dragfile.gif
│   │   │   │   ├── dragicon.gif
│   │   │   │   ├── error.gif
│   │   │   │   ├── file.gif
│   │   │   │   ├── folder.gif
│   │   │   │   ├── hourglass.gif
│   │   │   │   ├── info.gif
│   │   │   │   ├── italic.gif
│   │   │   │   ├── minus.xbm
│   │   │   │   ├── new.gif
│   │   │   │   ├── opcopy.xbm
│   │   │   │   ├── openfold.gif
│   │   │   │   ├── open.gif
│   │   │   │   ├── oplink.xbm
│   │   │   │   ├── opmove.xbm
│   │   │   │   ├── overstrike.gif
│   │   │   │   ├── palette.gif
│   │   │   │   ├── passwd.gif
│   │   │   │   ├── paste.gif
│   │   │   │   ├── plus.xbm
│   │   │   │   ├── print.gif
│   │   │   │   ├── question.gif
│   │   │   │   ├── redo.gif
│   │   │   │   ├── save.gif
│   │   │   │   ├── target.xbm
│   │   │   │   ├── underline.gif
│   │   │   │   ├── undo.gif
│   │   │   │   └── warning.gif
│   │   │   ├── init.tcl
│   │   │   ├── labelentry.tcl
│   │   │   ├── labelframe.tcl
│   │   │   ├── label.tcl
│   │   │   ├── lang
│   │   │   │   ├── de.rc
│   │   │   │   ├── en.rc
│   │   │   │   ├── es.rc
│   │   │   │   └── fr.rc
│   │   │   ├── LICENSE.txt
│   │   │   ├── listbox.tcl
│   │   │   ├── mainframe.tcl
│   │   │   ├── Makefile.in
│   │   │   ├── messagedlg.tcl
│   │   │   ├── notebook.tcl
│   │   │   ├── pagesmgr.tcl
│   │   │   ├── panedw.tcl
│   │   │   ├── passwddlg.tcl
│   │   │   ├── pkgIndex.tcl
│   │   │   ├── progressbar.tcl
│   │   │   ├── progressdlg.tcl
│   │   │   ├── README.txt
│   │   │   ├── scrollframe.tcl
│   │   │   ├── scrollview.tcl
│   │   │   ├── scrollw.tcl
│   │   │   ├── separator.tcl
│   │   │   ├── spinbox.tcl
│   │   │   ├── tests
│   │   │   │   └── entry.test
│   │   │   ├── titleframe.tcl
│   │   │   ├── tree.tcl
│   │   │   ├── utils.tcl
│   │   │   ├── widget.tcl
│   │   │   ├── wizard.tcl
│   │   │   └── xpm2image.tcl
│   │   ├── cmdTop.fm
│   │   ├── ColorEditor.fm
│   │   ├── colorplateDemo.fm
│   │   ├── ColorPlatePopup.fm
│   │   ├── commandwindow.fm
│   │   ├── content.html
│   │   ├── dbProcMap.tb
│   │   ├── dbViewerFm
│   │   │   ├── dbTclShell.fm
│   │   │   ├── dbTopWnd.fm
│   │   │   ├── dbTopWnd.menu
│   │   │   ├── dbTopWndStatus.fm
│   │   │   ├── icon
│   │   │   │   └── xpm
│   │   │   │   ├── down.xpm
│   │   │   │   ├── open.icon
│   │   │   │   ├── up.xpm
│   │   │   │   ├── zoomAll.xpm
│   │   │   │   ├── zoomIn.xpm
│   │   │   │   └── zoomOut.xpm
│   │   │   ├── kvOpenLib.fm
│   │   │   └── toolbar
│   │   │   ├── dbTopWndStatus_Config_topWndToolbar.fm
│   │   │   ├── dbTopWndStatus_Popup_FileUtil.fm
│   │   │   └── dbTopWndStatus_Popup_ViewUtil.fm
│   │   ├── draw
│   │   │   ├── dr.menu
│   │   │   ├── drStatus.fm
│   │   │   ├── drTop.fm
│   │   │   └── icon
│   │   │   └── xpm
│   │   │   └── clear.xpm
│   │   ├── drawAreaContainer.fm
│   │   ├── dump2prt.fm
│   │   ├── dumpWnd.fm
│   │   ├── envvar.dat
│   │   ├── env.xls
│   │   ├── files.tcl
│   │   ├── Filter.fm
│   │   ├── general.ltf
│   │   ├── gtProcMap.tb
│   │   ├── guiCmdObjBreak.fm
│   │   ├── guiDefault.menu
│   │   ├── guiTest
│   │   │   ├── demoMenu.fm
│   │   │   ├── demoMenu.menu
│   │   │   ├── demoMenuStatus.fm
│   │   │   ├── demoTTFont.fm
│   │   │   ├── demoTTFont.menu
│   │   │   ├── demoTTFontStatus.fm
│   │   │   ├── icon
│   │   │   │   └── xpm
│   │   │   │   └── open.icon
│   │   │   ├── main.fm
│   │   │   ├── main.menu
│   │   │   ├── mainStatus.fm
│   │   │   ├── unitGeo.fm
│   │   │   ├── unitGeo.menu
│   │   │   ├── unitGeoStatus.fm
│   │   │   ├── unitGrid.fm
│   │   │   ├── unitMenu.fm
│   │   │   ├── unitMenu.menu
│   │   │   └── unitMenuStatus.fm
│   │   ├── helpView.fm
│   │   ├── helpViewSearch.fm
│   │   ├── icon
│   │   │   ├── png
│   │   │   │   ├── diffDoc.png
│   │   │   │   ├── diffFolder.png
│   │   │   │   ├── ftv2blank.png
│   │   │   │   ├── ftv2doc.png
│   │   │   │   ├── ftv2folderclosed.png
│   │   │   │   ├── ftv2folderopen.png
│   │   │   │   ├── ftv2lastnode.png
│   │   │   │   ├── ftv2link.png
│   │   │   │   ├── ftv2mlastnode.png
│   │   │   │   ├── ftv2mnode.png
│   │   │   │   ├── ftv2node.png
│   │   │   │   ├── ftv2plastnode.png
│   │   │   │   ├── ftv2pnode.png
│   │   │   │   └── ftv2vertline.png
│   │   │   ├── xbm
│   │   │   │   ├── down.xbm
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│   │   │   ├── license.terms
│   │   │   ├── listbox.tcl
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│   │   ├── fsmFind.fm
│   │   ├── fsmFindSig.fm
│   │   ├── fsm.menu
│   │   ├── fsmObjProp.fm
│   │   ├── fsmPrint.fm
│   │   ├── fsmPrintPreview.fm
│   │   ├── fsmProp.fm
│   │   ├── fsmReport.fm
│   │   ├── fsm.res
│   │   ├── fsmSearch.fm
│   │   ├── fsmSequence.fm
│   │   ├── _fsmSignal.fm
│   │   ├── fsmStatus.fm
│   │   ├── icon
│   │   │   ├── xbm
│   │   │   │   ├── left.xbm
│   │   │   │   └── right.xbm
│   │   │   └── xpm
│   │   │   ├── 100Z.xpm
│   │   │   ├── backward.xpm
│   │   │   ├── bySeq.xpm
│   │   │   ├── byState.xpm
│   │   │   ├── cut.xpm
│   │   │   ├── delMask.xpm
│   │   │   ├── editDesignSheet.xpm
│   │   │   ├── fromState.xpm
│   │   │   ├── fsmBackground.xpm
│   │   │   ├── fsmCoverState.xpm
│   │   │   ├── fsmCoverTrans.xpm
│   │   │   ├── fsmHDL.xpm
│   │   │   ├── nextState.xpm
│   │   │   ├── nState_icon.xpm
│   │   │   ├── prevState.xpm
│   │   │   ├── SimOff.xpm
│   │   │   ├── SimOn.xpm
│   │   │   ├── toState.xpm
│   │   │   ├── undo.xpm
│   │   │   ├── zoomIn.xpm
│   │   │   └── zoomOut.xpm
│   │   ├── reuFsm
│   │   │   ├── fsmAlias.fm
│   │   │   ├── fsmAliasState.fm
│   │   │   ├── fsmEdDsgWnd.fm
│   │   │   ├── fsmEdMatching.fm
│   │   │   ├── fsmEd.menu
│   │   │   ├── fsmEdModuleMatch.fm
│   │   │   ├── fsmEdSaveTplg.fm
│   │   │   ├── fsmEdStatus.fm
│   │   │   ├── fsmEdViewObj.fm
│   │   │   ├── fsmFontPref.fm
│   │   │   ├── fsmRename.fm
│   │   │   ├── icon
│   │   │   │   └── xpm
│   │   │   │   ├── 100Z.xpm
│   │   │   │   ├── AddPlaneText.xpm
│   │   │   │   ├── backward.xpm
│   │   │   │   ├── browseOnly.xpm
│   │   │   │   ├── bySeq.xpm
│   │   │   │   ├── byState.xpm
│   │   │   │   ├── cmt1SideIndicator.xpm
│   │   │   │   ├── cmtArrow.xpm
│   │   │   │   ├── cmtAttached.xpm
│   │   │   │   ├── cmtIndicator.xpm
│   │   │   │   ├── cmtPeriod.xpm
│   │   │   │   ├── cmtRecIndicator.xpm
│   │   │   │   ├── cmtSquare.xpm
│   │   │   │   ├── copy.xpm
│   │   │   │   ├── delMask.xpm
│   │   │   │   ├── down.xpm
│   │   │   │   ├── fromState.xpm
│   │   │   │   ├── left2.xpm
│   │   │   │   ├── leftArrow.xpm
│   │   │   │   ├── left.xpm
│   │   │   │   ├── loadDesignSheet.xpm
│   │   │   │   ├── nextState.xpm
│   │   │   │   ├── paste.xpm
│   │   │   │   ├── popup.xpm
│   │   │   │   ├── prevState.xpm
│   │   │   │   ├── pushdown.xpm
│   │   │   │   ├── reArrangeTransition.xpm
│   │   │   │   ├── redo.xpm
│   │   │   │   ├── Reu_FSM.xpm
│   │   │   │   ├── right2.xpm
│   │   │   │   ├── rightArrow.xpm
│   │   │   │   ├── right.xpm
│   │   │   │   ├── saveDesignSheet.xpm
│   │   │   │   ├── SimOff.xpm
│   │   │   │   ├── SimOn.xpm
│   │   │   │   ├── toolBarArrowLine.xpm
│   │   │   │   ├── toolBarEllipse.xpm
│   │   │   │   ├── toolBarLine.xpm
│   │   │   │   ├── toolBarPolyLine.xpm
│   │   │   │   ├── toolBarRectangle.xpm
│   │   │   │   ├── toState.xpm
│   │   │   │   ├── undo.xpm
│   │   │   │   ├── up.xpm
│   │   │   │   ├── zoomIn.xpm
│   │   │   │   └── zoomOut.xpm
│   │   │   ├── reuFsm.res
│   │   │   └── reuFsm.res.qds
│   │   └── toolbar
│   │   ├── fsmStatus_Config_COMMAND_PANEL.fm
│   │   ├── fsmStatus_Popup_FSM_EDIT_DS_GROUP.fm
│   │   ├── fsmStatus_Popup_FSM_EDIT.fm
│   │   ├── fsmStatus_Popup_FSM_JUMP.fm
│   │   ├── fsmStatus_Popup_FSM_SEARCH.fm
│   │   ├── fsmStatus_Popup_FSM_SIMULATION.fm
│   │   ├── fsmStatus_Popup_FSM_VIEW.fm
│   │   └── fsmStatus_Popup_FSM_VIEW_GROUP.fm
│   ├── hb
│   │   ├── addUserCmd.fm
│   │   ├── addWatch.fm
│   │   ├── autoAlias.fm
│   │   ├── breakPoint.fm
│   │   ├── browseCell.fm
│   │   ├── browserSigOpt.fm
│   │   ├── browseSignal.fm
│   │   ├── cmdEntry.fm
│   │   ├── compile.fm
│   │   ├── compileOpt_FL.fm
│   │   ├── compileOpt.fm
│   │   ├── Debussy.menu
│   │   ├── Debussy.menu.qds
│   │   ├── Debussyv.menu
│   │   ├── dumpScope.fm
│   │   ├── editUserCmd.fm
│   │   ├── exportTree.fm
│   │   ├── fileWithNote.fm
│   │   ├── focus.fm
│   │   ├── hbCapture.fm
│   │   ├── hb.menu
│   │   ├── hbStatus.fm
│   │   ├── hbStatus.fm.qds
│   │   ├── hbTopWin.fm
│   │   ├── hbvStatus.fm
│   │   ├── icon
│   │   │   ├── xbm
│   │   │   │   ├── down.xbm
│   │   │   │   ├── left.xbm
│   │   │   │   ├── lineDashDotDot.xbm
│   │   │   │   ├── lineDashDot.xbm
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│   │   │   │   ├── lineDot.xbm
│   │   │   │   ├── lineSolid.xbm
│   │   │   │   ├── right.xbm
│   │   │   │   ├── undo.xbm
│   │   │   │   └── up.xbm
│   │   │   └── xpm
│   │   │   ├── 100Z.xpm
│   │   │   ├── backward2.xpm
│   │   │   ├── backward.xpm
│   │   │   ├── bigZ.xpm
│   │   │   ├── bookmark.xpm
│   │   │   ├── break.xpm
│   │   │   ├── change.xpm
│   │   │   ├── cycle.xpm
│   │   │   ├── delMask.xpm
│   │   │   ├── driver.xpm
│   │   │   ├── editor.xpm
│   │   │   ├── failure.xpm
│   │   │   ├── fall.xpm
│   │   │   ├── findNext.xpm
│   │   │   ├── findPrev.xpm
│   │   │   ├── finish.xpm
│   │   │   ├── forward2.xpm
│   │   │   ├── fsmHDL.xpm
│   │   │   ├── go.xpm
│   │   │   ├── hold.xpm
│   │   │   ├── load.xpm
│   │   │   ├── nBenchTool.xpm
│   │   │   ├── nextBlk.xpm
│   │   │   ├── nextBP.xpm
│   │   │   ├── nextChg.xpm
│   │   │   ├── nextEvent.xpm
│   │   │   ├── nextTime.xpm
│   │   │   ├── open.icon
│   │   │   ├── phase.xpm
│   │   │   ├── popup.xpm
│   │   │   ├── prevBlk.xpm
│   │   │   ├── prevBP.xpm
│   │   │   ├── prevChg.xpm
│   │   │   ├── prevEvent.xpm
│   │   │   ├── prevTime.xpm
│   │   │   ├── pushdown.xpm
│   │   │   ├── rise.xpm
│   │   │   ├── smallZ.xpm
│   │   │   ├── start_eval.xpm
│   │   │   ├── success.xpm
│   │   │   ├── SvaStart.xpm
│   │   │   ├── TF.xpm
│   │   │   ├── TG.xpm
│   │   │   ├── tracer_icon.xpm
│   │   │   ├── TW.xpm
│   │   │   ├── unhold.xpm
│   │   │   ├── zoomIn.xpm
│   │   │   └── zoomOut.xpm
│   │   ├── importDsg.fm
│   │   ├── importDsg.fm.org
│   │   ├── importHVL.fm
│   │   ├── importOptions.fm
│   │   ├── importProp.fm
│   │   ├── importSDF.fm
│   │   ├── impVhdSrcOpt.fm
│   │   ├── invokeCmd.fm
│   │   ├── libMap.fm
│   │   ├── loadFile.fm
│   │   ├── openSource.fm
│   │   ├── preference.fm
│   │   ├── preference.fm.qds
│   │   ├── saveSession.fm
│   │   ├── sdfUndefCount.fm
│   │   ├── searchScope.fm
│   │   ├── setTop_FL.fm
│   │   ├── showVar.fm
│   │   ├── showWatch.fm
│   │   ├── showWatchOpt.fm
│   │   ├── srcDebug.fm
│   │   ├── srcTraceRange.fm
│   │   ├── timeRange.fm
│   │   ├── toolbar
│   │   │   ├── hbStatus_Config_HB_MAIN_TOOLBAR.fm
│   │   │   ├── hbStatus_Popup_HB_BA_COMMAND_PANEL.fm
│   │   │   ├── hbStatus_Popup_HB_EDIT_COMMAND_PANEL.fm
│   │   │   ├── hbStatus_Popup_HB_IMPORT_COMMAND_PANEL.fm
│   │   │   ├── hbStatus_Popup_HB_NEW_COMMAND_PANEL.fm
│   │   │   ├── hbStatus_Popup_HB_SELECT_COMMAND_PANEL.fm
│   │   │   ├── hbStatus_Popup_HB_SIM_COMMAND_PANEL.fm
│   │   │   ├── hbStatus_Popup_HB_SOURCE_COMMAND_PANEL.fm
│   │   │   ├── hbStatus_Popup_HB_TRACE_COMMAND_PANEL.fm
│   │   │   └── hbStatus_Popup_SCHEMA_COMMAND_PANEL.fm
│   │   ├── userCommand.fm
│   │   ├── vhdlSetTop.fm
│   │   └── WatchExp.fm
│   ├── kdb
│   │   ├── c.ltf
│   │   ├── cpp.ltf
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│   │   ├── envvar.dat
│   │   ├── generic.sym
│   │   ├── hdl
│   │   │   ├── 32
│   │   │   │   ├── and
│   │   │   │   ├── buf
│   │   │   │   ├── bufif0
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│   │   │   │   ├── cmos
│   │   │   │   ├── nand
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│   │   │   │   ├── not
│   │   │   │   ├── notif0
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│   │   │   │   ├── xnor
│   │   │   │   └── xor
│   │   │   └── 64
│   │   │   ├── and
│   │   │   ├── buf
│   │   │   ├── bufif0
│   │   │   ├── bufif1
│   │   │   ├── cmos
│   │   │   ├── nand
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│   │   │   ├── notif0
│   │   │   ├── notif1
│   │   │   ├── or
│   │   │   ├── pmos
│   │   │   ├── pulldown
│   │   │   ├── pullup
│   │   │   ├── rcmos
│   │   │   ├── rnmos
│   │   │   ├── rpmos
│   │   │   ├── rtran
│   │   │   ├── rtranif0
│   │   │   ├── rtranif1
│   │   │   ├── tran
│   │   │   ├── tranif0
│   │   │   ├── tranif1
│   │   │   ├── xnor
│   │   │   └── xor
│   │   ├── icon
│   │   │   └── xbm
│   │   │   ├── drag_file.xbm
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│   │   ├── importDesign.fm
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│   │   ├── text
│   │   │   ├── icon
│   │   │   │   ├── xbm
│   │   │   │   │   ├── down.xbm
│   │   │   │   │   ├── left.xbm
│   │   │   │   │   ├── right.xbm
│   │   │   │   │   └── up.xbm
│   │   │   │   └── xpm
│   │   │   │   ├── backward2.xpm
│   │   │   │   ├── bookmark.xpm
│   │   │   │   ├── change.xpm
│   │   │   │   ├── copy.xpm
│   │   │   │   ├── cut.xpm
│   │   │   │   ├── driver.xpm
│   │   │   │   ├── editor.xpm
│   │   │   │   ├── fall.xpm
│   │   │   │   ├── findNext.xpm
│   │   │   │   ├── findPrev.xpm
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│   │   ├── verilog.ltf
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│   │   │   ├── 32
│   │   │   │   ├── ieee.lib++
│   │   │   │   │   ├── andgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── buf3s
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── buf3sl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── bufgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_andgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_andgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_buf3s_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_buf3s_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_buf3sl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_buf3sl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_bufgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_bufgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffreg_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffreg_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregsrh_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregsrh_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregsrl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregsrl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatram_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatreg_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatreg_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregsrh_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregsrh_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregsrl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregsrl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatrom_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_inv3s_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_inv3s_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_inv3sl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_inv3sl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_invgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_invgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_mpwck_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_mux2x1_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_mux2x1_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nandgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nandgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_norgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_norgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nrxfergate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nxfergate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nxorgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nxorgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_orgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_orgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_prxfergate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_pxfergate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_recovck_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_resistor_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_resistor_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_suhdck_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_wbufgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_wbufgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_xnorgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_xnorgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_xorgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_xorgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dffreg
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dffregl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dffregsrh
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dffregsrl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatram
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatreg
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatregl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatregsrh
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatregsrl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatrom
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── gs_types
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── gs_types.vhd.tdc
│   │   │   │   │   ├── inv3s
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── inv3sl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── invgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── lib.dep
│   │   │   │   │   ├── libfile
│   │   │   │   │   ├── libfile.1-
│   │   │   │   │   ├── MapTbl
│   │   │   │   │   ├── math_complex
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── math_real
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── mpwck
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── mti_numeric_bit.vhd.tdc
│   │   │   │   │   ├── mti_numeric_std.vhd.tdc
│   │   │   │   │   ├── mti_std_logic_arith.vhd.tdc
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│   │   │   │   │   ├── mti_std_logic_signed.vhd.tdc
│   │   │   │   │   ├── mti_std_logic_unsigned.vhd.tdc
│   │   │   │   │   ├── mux2x1
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── nandgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── norgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── nrxfergate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── numeric_bit
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── numeric_std
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── nxfergate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── nxorgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── orgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── prmtvs_b.vhd.tdc
│   │   │   │   │   ├── prmtvs_p.vhd.tdc
│   │   │   │   │   ├── prxfergate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── pxfergate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── recovck
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── resistor
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── std_logic_1164
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── std_logic_arith
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── std_logic_components
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── std_logic_components.vhd.tdc
│   │   │   │   │   ├── std_logic_entities.vhd.tdc
│   │   │   │   │   ├── std_logic_misc
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── std_logic_signed
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── std_logic_textio
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── std_logic_textio.vhd.tdc
│   │   │   │   │   ├── std_logic_unsigned
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── stdlogic.vhd.tdc
│   │   │   │   │   ├── suhdck
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── timing_b.vhd.tdc
│   │   │   │   │   ├── timing_p.vhd.tdc
│   │   │   │   │   ├── vital_primitives
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── vital_timing
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── wbufgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── xnorgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   └── xorgate
│   │   │   │   │   ├── a.data
│   │   │   │   │   ├── bi.data
│   │   │   │   │   └── _primary.data
│   │   │   │   ├── novas.lib++
│   │   │   │   │   ├── lib.dep
│   │   │   │   │   ├── libfile
│   │   │   │   │   ├── MapTbl
│   │   │   │   │   ├── novas
│   │   │   │   │   │   ├── novas_arch.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── novas.vhd.tdc
│   │   │   │   │   └── pkg
│   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   └── _primary.data
│   │   │   │   ├── std.lib++
│   │   │   │   │   ├── lib.dep
│   │   │   │   │   ├── libfile
│   │   │   │   │   ├── libfile.1-
│   │   │   │   │   ├── MapTbl
│   │   │   │   │   ├── standard
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── standard.vhd.tdc
│   │   │   │   │   ├── textio
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   └── textio.vhd.tdc
│   │   │   │   ├── synopsys.lib++
│   │   │   │   │   ├── arithmetic
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── attributes
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── lib.dep
│   │   │   │   │   ├── libfile
│   │   │   │   │   ├── MapTbl
│   │   │   │   │   ├── syn_ari.vhd.tdc
│   │   │   │   │   ├── syn_attributes.vhd.tdc
│   │   │   │   │   ├── syn_type.vhd.tdc
│   │   │   │   │   └── types
│   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   └── _primary.data
│   │   │   │   └── vital2000.lib++
│   │   │   │   ├── lib.dep
│   │   │   │   ├── libfile
│   │   │   │   ├── libfile.1-
│   │   │   │   ├── MapTbl
│   │   │   │   ├── memory_b_2000.vhd.tdc
│   │   │   │   ├── memory_p_2000.vhd.tdc
│   │   │   │   ├── prmtvs_b_2000.vhd.tdc
│   │   │   │   ├── prmtvs_p_2000.vhd.tdc
│   │   │   │   ├── timing_b_2000.vhd.tdc
│   │   │   │   ├── timing_p_2000.vhd.tdc
│   │   │   │   ├── vital_memory
│   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   └── _primary.data
│   │   │   │   ├── vital_primitives
│   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   └── _primary.data
│   │   │   │   └── vital_timing
│   │   │   │   ├── _primary_body.data
│   │   │   │   └── _primary.data
│   │   │   ├── 64
│   │   │   │   ├── ieee.lib++
│   │   │   │   │   ├── andgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── buf3s
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── buf3sl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── bufgate
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_andgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_andgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_buf3s_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_buf3s_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_buf3sl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_buf3sl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_bufgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_bufgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffreg_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffreg_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregsrh_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregsrh_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregsrl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dffregsrl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatram_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatreg_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatreg_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregsrh_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregsrh_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregsrl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatregsrl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_dlatrom_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_inv3s_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_inv3s_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_inv3sl_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_inv3sl_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_invgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_invgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_mpwck_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_mux2x1_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_mux2x1_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nandgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nandgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_norgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_norgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nrxfergate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nxfergate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nxorgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_nxorgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_orgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_orgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_prxfergate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_pxfergate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_recovck_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_resistor_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_resistor_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_suhdck_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_wbufgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_wbufgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_xnorgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_xnorgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_xorgate_a
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── cfg_xorgate_bi
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dffreg
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dffregl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dffregsrh
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dffregsrl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatram
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatreg
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatregl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatregsrh
│   │   │   │   │   │   ├── a.data
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│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── dlatregsrl
│   │   │   │   │   │   ├── a.data
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│   │   │   │   │   ├── dlatrom
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── gs_types
│   │   │   │   │   │   ├── _primary_body.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── gs_types.vhd.tdc
│   │   │   │   │   ├── inv3s
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── inv3sl
│   │   │   │   │   │   ├── a.data
│   │   │   │   │   │   ├── bi.data
│   │   │   │   │   │   └── _primary.data
│   │   │   │   │   ├── invgate
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│   │   │   │   ├── next.xpm
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│   │   │   │   ├── prev.xpm
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│   │   │   │   ├── Reu_Sch.xpm
│   │   │   │   ├── right2.xpm
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│   │   │   ├── icon
│   │   │   │   ├── xbm
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│   │   │   │   ├── lineSolid.xbm
│   │   │   │   ├── play.xbm
│   │   │   │   ├── right.xbm
│   │   │   │   ├── schemaX.xbm
│   │   │   │   ├── stop.xbm
│   │   │   │   ├── up.xbm
│   │   │   │   └── vcdAddSignal.icon
│   │   │   └── xpm
│   │   │   ├── a1
│   │   │   ├── arrow.xpm
│   │   │   ├── camera_lens.xpm
│   │   │   ├── change.xpm
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│   │   │   ├── find.xpm
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│   │   │   ├── lock.xpm
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│   │   │   ├── nStateAbout.xpm
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│   │   │   ├── nWaveAbout.xpm
│   │   │   ├── off.xpm
│   │   │   ├── open.icon
│   │   │   ├── Reusner.xpm
│   │   │   ├── rise.xpm
│   │   │   ├── TG.xpm
│   │   │   ├── tracer_icon.xpm
│   │   │   ├── TW.xpm
│   │   │   ├── undo.xpm
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│   │   ├── mbWin.fm
│   │   ├── mdaGetSignal.fm
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│   │   ├── nmemGetVar.fm
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│   │   ├── nmemOpt2.fm
│   │   ├── nmemOpt.fm
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│   │   ├── nmemSearch.fm
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│   │   ├── PrintPreview.fm
│   │   ├── reg.menu
│   │   ├── regPrint.fm
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│   │   ├── regstatus.fm
│   │   ├── regWndForm.fm
│   │   ├── reuShare
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│   │   │   ├── cmtGraphicsTypeSelect.fm
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│   │   │   ├── dragIcon.fm
│   │   │   ├── DummyMgrTool.fm
│   │   │   ├── fsmTplgMgrSave.fm
│   │   │   ├── helpStatus.fm
│   │   │   ├── icon
│   │   │   │   ├── xbm
│   │   │   │   │   ├── down.xbm
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│   │   │   │   │   ├── drag_inst.xbm
│   │   │   │   │   ├── drag_scope.xbm
│   │   │   │   │   ├── drag_signal.xbm
│   │   │   │   │   ├── drag.xbm
│   │   │   │   │   ├── mask.xbm
│   │   │   │   │   └── up.xbm
│   │   │   │   └── xpm
│   │   │   │   ├── addBook.xpm
│   │   │   │   ├── ArrowTypeCircleS.xpm
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│   │   │   │   ├── bottomSide.xpm
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│   │   │   │   ├── copy.xpm
│   │   │   │   ├── cut.xpm
│   │   │   │   ├── delMask.xpm
│   │   │   │   ├── down.xpm
│   │   │   │   ├── helpGoHome.xpm
│   │   │   │   ├── helpGoNext.xpm
│   │   │   │   ├── helpGoPrev.xpm
│   │   │   │   ├── leftSide.xpm
│   │   │   │   ├── newBook.xpm
│   │   │   │   ├── newDesign.xpm
│   │   │   │   ├── newFolder.xpm
│   │   │   │   ├── paste.xpm
│   │   │   │   ├── popUpArrowLine.xpm
│   │   │   │   ├── popUpEllipse.xpm
│   │   │   │   ├── popUpLine.xpm
│   │   │   │   ├── popUpPlainText.xpm
│   │   │   │   ├── popUpPolyLine.xpm
│   │   │   │   ├── popUpRectangle.xpm
│   │   │   │   ├── question.xpm
│   │   │   │   ├── removeBook.xpm
│   │   │   │   ├── rightSide.xpm
│   │   │   │   ├── topSide.xpm
│   │   │   │   └── up.xpm
│   │   │   ├── nvAskOldConnStyle.fm
│   │   │   ├── nvMatching.fm
│   │   │   ├── resource.fm
│   │   │   ├── reu.png
│   │   │   ├── reuSchBookSelect.fm
│   │   │   ├── reuSchPinInfoExport.fm
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│   │   │   ├── reuShare.res
│   │   │   ├── reuShare.res.qds
│   │   │   ├── schDumpAU.fm
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│   │   │   ├── schEzBBLink.fm
│   │   │   ├── schEzBBMove.fm
│   │   │   ├── schEzBBRename.fm
│   │   │   ├── schEzBBTplg.fm
│   │   │   ├── schEzBundleCreate.fm
│   │   │   ├── schEzBundleMove.fm
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│   │   │   ├── schEzPrjMgrBBLink.fm
│   │   │   ├── schEzPrjMgrBBTplg.fm
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│   │   │   ├── tplgMgrSave.fm
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│   │   ├── schFind.fm
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│   │   ├── textMacroCmd.fm
│   │   ├── textPrintFile.fm
│   │   ├── textReplace.fm
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│   │   ├── toolbar
│   │   │   ├── mdaStatus_Config_MDA_COMMAND_PANEL.fm
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│   ├── waveSlew.fm
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├── license
└── share
├── cmdshlib
│   ├── cmdshlib.cpp.example
│   ├── cmdshlib.h
│   └── cmdshlib.README.pdf
├── FsdbWriter
│   ├── doc
│   │   ├── OpenFsdbWriter.pdf
│   │   └── README_ffr.pdf
│   ├── example
│   │   ├── autoform_bus.cpp
│   │   ├── autoswf.cpp
│   │   ├── bus.cpp
│   │   ├── clk.cpp
│   │   ├── data_type.cpp
│   │   ├── dtree.cpp
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│   │   ├── ebc.cpp
│   │   ├── epic.cpp
│   │   ├── evcd.cpp
│   │   ├── huge_bus.cpp
│   │   ├── interactive.cpp
│   │   ├── memory.cpp
│   │   ├── misc.cpp
│   │   ├── mul_obj.cpp
│   │   ├── ord.cpp
│   │   ├── pattern.cpp
│   │   ├── prop.cpp
│   │   ├── real.cpp
│   │   ├── scope.cpp
│   │   ├── session.cpp
│   │   ├── signal_based.cpp
│   │   ├── stree.cpp
│   │   ├── string.cpp
│   │   ├── supinfo.cpp
│   │   ├── traffic.cpp
│   │   ├── transaction_recording.cpp
│   │   ├── tvc.cpp
│   │   ├── vc.cpp
│   │   └── vhdl.cpp
│   ├── ffwAPI.h
│   ├── ffwTest.makefile
│   ├── FILE_LIST
│   ├── fsdbShr.h
│   └── WINNT
│   ├── COMPILER_DEF
│   ├── ffwAPIexp.lib
│   ├── libnffw.dll
│   └── libnffw.lib
├── libcmd
│   ├── cmdclt.h
│   ├── doc
│   │   ├── a.cmd
│   │   ├── nECO_tcl.pdf
│   │   ├── signal_finder.tcl
│   │   ├── signal.list
│   │   ├── socketClientW.c
│   │   └── tcl.pdf
│   ├── java_cmdlib
│   │   ├── CmdEventCallback.class
│   │   ├── novas
│   │   │   └── sockcmd
│   │   │   ├── CheckForEventsTimer.class
│   │   │   ├── CmdClient.class
│   │   │   ├── CmdEvent.class
│   │   │   ├── CmdEventInfo.class
│   │   │   ├── CmdResult.class
│   │   │   ├── CmdStoredEvent.class
│   │   │   ├── SocketBuf.class
│   │   │   └── SocketClient.class
│   │   ├── README
│   │   ├── test.java
│   │   └── TestSockCmd.class
│   └── WINNT
│   ├── libnclt.lib
│   └── libnsys.lib
├── PLI
│   ├── linking.pdf
│   ├── modelsim_fli53
│   │   └── WINNT
│   │   ├── fli.lib
│   │   ├── make.bat
│   │   ├── novasfli.c
│   │   ├── novas_fli.dll
│   │   ├── novas_fli_exp.nt
│   │   └── novas.vhd
│   ├── modelsim_fli54
│   │   └── WINNT
│   │   ├── fli.lib
│   │   ├── make.bat
│   │   ├── novasfli.c
│   │   ├── novas_fli.dll
│   │   ├── novas_fli_exp.nt
│   │   └── novas.vhd
│   ├── modelsim_pli
│   │   └── WINNT
│   │   ├── make.bat
│   │   ├── novas.dll
│   │   ├── novas_vlog.v
│   │   ├── pli.lib
│   │   └── veriuser.c
│   ├── modelsim_pli54
│   │   └── WINNT
│   │   ├── make.bat
│   │   ├── novas.dll
│   │   ├── novas_vlog.v
│   │   ├── pli.lib
│   │   └── veriuser.c
│   ├── nc51
│   │   └── WINNT
│   │   ├── loadpli1
│   │   │   └── debpli.dll
│   │   ├── ncmake.bat
│   │   ├── pli.lib
│   │   ├── shared
│   │   │   └── libpli.dll
│   │   └── veriuser.c
│   ├── nc_vhdl
│   │   └── WINNT
│   │   ├── fmi.lib
│   │   ├── libcfc.dll
│   │   ├── libfmi.dll
│   │   ├── makelibfmi.bat
│   │   ├── novascfc.c
│   │   ├── novasfmi.c
│   │   └── novas.vhd
│   ├── nc_xl
│   │   └── WINNT
│   │   ├── loadpli1
│   │   │   └── debpli.dll
│   │   ├── makepli.bat
│   │   ├── pli.lib
│   │   ├── shared
│   │   │   └── libpli.dll
│   │   └── veriuser.c
│   ├── plugInSim.pdf
│   ├── README.PLI
│   ├── vcs
│   │   └── WINNT
│   │   ├── novas.tab
│   │   └── pli.lib
│   └── vcsd
│   └── WINNT
│   ├── pli.lib
│   └── vcsd.tab
└── symlib
└── 32
├── default_l.lib++
│   ├── libfile
│   ├── _sarch.0
│   ├── _sarch.1
│   ├── _sarch.2
│   ├── _sarch.3
│   └── techfile
├── default_u.lib++
│   ├── libfile
│   ├── _sarch.0
│   ├── _sarch.1
│   ├── _sarch.2
│   ├── _sarch.3
│   └── techfile
├── lsi10k_l.lib++
│   ├── libfile
│   ├── _sarch.0
│   └── _sarch.1
├── lsi10k_u.lib++
│   ├── libfile
│   ├── _sarch.0
│   └── _sarch.1
├── tsmc773_l.lib++
│   ├── libfile
│   ├── _sarch.0
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│   ├── _sarch.3
│   ├── _sarch.4
│   ├── _sarch.5
│   ├── _sarch.6
│   ├── _sarch.7
│   └── techfile
└── tsmc773_u.lib++
├── libfile
├── _sarch.0
├── _sarch.1
├── _sarch.2
├── _sarch.3
├── _sarch.4
├── _sarch.5
├── _sarch.6
├── _sarch.7
└── techfile

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