实例介绍
【实例简介】
FPGA中主要模块包含：时钟模块、OV7670初始化模块、DVP协议数据流模块、写FIFO模块、写FIFO控制模块、SDRAM控制模块、读FIFO模块、读FIFO控制模块、VGA控制模块。 其中OV7670初始化模块、DVP协议数据流模块和VGA控制模块都在本专题博客中写过，这里不再赘述。写FIFO和读FIFO模块使用的IP核，都是宽度16位，长度256，其中读FIFO使用的是showahead模式。SDRAM控制器漆面的博客也写过，这边做了一些改动，添加了一些需要的信号。 其整体流程为：启动时先对摄像头进行初始化设置，初始化完成后，FPGA从摄像头获取一帧一帧的图像数据，根据数
【实例截图】
【核心代码】
4744300845370645736.zip
└── camera_ov7670
├── doc
│ └── 绘图1.vsdx
├── img
│ ├── 1.jpg
│ ├── 2.jpg
│ ├── 3.jpg
│ ├── 4.jpg
│ └── 整体系统框图.png
├── prj
│ ├── camera_ov7670.ipregen.rpt
│ ├── camera_ov7670_nativelink_simulation.rpt
│ ├── camera_ov7670.qpf
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│ │ │ ├── camera_ov7670.root_partition.map.hdb
│ │ │ ├── camera_ov7670.root_partition.map.kpt
│ │ │ └── camera_ov7670.rrp.hdb
│ │ └── README
│ ├── output_files
│ │ ├── camera_ov7670.asm.rpt
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│ │ ├── camera_ov7670.eda.rpt
│ │ ├── camera_ov7670.fit.rpt
│ │ ├── camera_ov7670.fit.smsg
│ │ ├── camera_ov7670.fit.summary
│ │ ├── camera_ov7670.flow.rpt
│ │ ├── camera_ov7670.jdi
│ │ ├── camera_ov7670.map.rpt
│ │ ├── camera_ov7670.map.summary
│ │ ├── camera_ov7670.pin
│ │ ├── camera_ov7670.sld
│ │ ├── camera_ov7670.sof
│ │ ├── camera_ov7670.sta.rpt
│ │ ├── camera_ov7670.sta.summary
│ │ └── stp1.stp
│ └── simulation
│ └── modelsim
│ ├── camera_ov7670_8_1200mv_0c_slow.vo
│ ├── camera_ov7670_8_1200mv_0c_v_slow.sdo
│ ├── camera_ov7670_8_1200mv_85c_slow.vo
│ ├── camera_ov7670_8_1200mv_85c_v_slow.sdo
│ ├── camera_ov7670_min_1200mv_0c_fast.vo
│ ├── camera_ov7670_min_1200mv_0c_v_fast.sdo
│ ├── camera_ov7670_modelsim.xrf
│ ├── camera_ov7670_run_msim_rtl_verilog.do
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak1
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│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak4
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak5
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak6
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak7
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak8
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak9
│ ├── camera_ov7670.sft
│ ├── camera_ov7670.vo
│ ├── camera_ov7670_v.sdo
│ ├── modelsim.ini
│ ├── msim_transcript
│ ├── rtl_work
│ │ ├── _info
│ │ ├── _lib1_4.qdb
│ │ ├── _lib1_4.qpg
│ │ ├── _lib1_4.qtl
│ │ ├── _lib.qdb
│ │ └── _vmake
│ ├── verilog_libs
│ │ ├── altera_lnsim_ver
│ │ │ ├── _info
│ │ │ ├── _lib1_9.qdb
│ │ │ ├── _lib1_9.qpg
│ │ │ ├── _lib1_9.qtl
│ │ │ ├── _lib.qdb
│ │ │ └── _vmake
│ │ ├── altera_mf_ver
│ │ │ ├── _info
│ │ │ ├── _lib1_9.qdb
│ │ │ ├── _lib1_9.qpg
│ │ │ ├── _lib1_9.qtl
│ │ │ ├── _lib.qdb
│ │ │ └── _vmake
│ │ ├── altera_ver
│ │ │ ├── _info
│ │ │ ├── _lib1_9.qdb
│ │ │ ├── _lib1_9.qpg
│ │ │ ├── _lib1_9.qtl
│ │ │ ├── _lib.qdb
│ │ │ └── _vmake
│ │ ├── cycloneive_ver
│ │ │ ├── _info
│ │ │ ├── _lib1_9.qdb
│ │ │ ├── _lib1_9.qpg
│ │ │ ├── _lib1_9.qtl
│ │ │ ├── _lib.qdb
│ │ │ └── _vmake
│ │ ├── lpm_ver
│ │ │ ├── _info
│ │ │ ├── _lib1_9.qdb
│ │ │ ├── _lib1_9.qpg
│ │ │ ├── _lib1_9.qtl
│ │ │ ├── _lib.qdb
│ │ │ └── _vmake
│ │ └── sgate_ver
│ │ ├── _info
│ │ ├── _lib1_9.qdb
│ │ ├── _lib1_9.qpg
│ │ ├── _lib1_9.qtl
│ │ ├── _lib.qdb
│ │ └── _vmake
│ ├── vsim.wlf
│ └── wlft2x25cx
├── rtl
│ ├── camera_ov7670_top_tb.v
│ ├── camera_ov7670_top.v
│ ├── camera_ov7670_top.v.bak
│ ├── IP_FIFO
│ │ ├── async_fifo_bb.v
│ │ ├── async_fifo_inst.v
│ │ ├── async_fifo.qip
│ │ ├── async_fifo_tb.v
│ │ └── async_fifo.v
│ ├── IP_FIFO_AHEAD
│ │ ├── async_fifo_ahead_bb.v
│ │ ├── async_fifo_ahead_inst.v
│ │ ├── async_fifo_ahead.qip
│ │ ├── async_fifo_ahead_tb.v
│ │ ├── async_fifo_ahead_tb.v.bak
│ │ └── async_fifo_ahead.v
│ ├── IP_PLL
│ │ ├── pll_bb.v
│ │ ├── pll_inst.v
│ │ ├── pll.ppf
│ │ ├── pll.qip
│ │ └── pll.v
│ ├── ov7670_config.v
│ ├── ov7670_data_16rgb565.v
│ ├── ov7670_init.v
│ ├── rd_control.v
│ ├── rd_control.v.bak
│ ├── SCCB_sender.v
│ ├── SDRAM_control.v
│ ├── SDRAM_control.v.bak
│ ├── VGA_ctrl.v
│ ├── work
│ │ ├── _info
│ │ ├── _lib1_0.qdb
│ │ ├── _lib1_0.qpg
│ │ ├── _lib1_0.qtl
│ │ ├── _lib.qdb
│ │ └── _vmake
│ ├── wr_control.v
│ └── wr_control.v.bak
└── sim
├── sdram_sim
│ ├── 111.cr.mti
│ ├── 111.mpf
│ ├── async_fifo_ahead.v
│ ├── async_fifo.v
│ ├── pll.v
│ ├── rd_control.v
│ ├── SDRAM_control_test_tb.v
│ ├── SDRAM_control_test_tb.v.bak
│ ├── SDRAM_control_test.v
│ ├── SDRAM_control_test.v.bak
│ ├── SDRAM_control.v
│ ├── sdram_model_plus.v
│ ├── vsim.wlf
│ ├── work
│ │ ├── _info
│ │ ├── _lib1_7.qdb
│ │ ├── _lib1_7.qpg
│ │ ├── _lib1_7.qtl
│ │ ├── _lib1_8.qdb
│ │ ├── _lib1_8.qpg
│ │ ├── _lib1_8.qtl
│ │ ├── _lib.qdb
│ │ └── _vmake
│ └── wr_control.v
└── sim1
├── 111.cr.mti
├── 111.mpf
├── transcript
├── vsim.wlf
└── work
├── _info
├── _lib1_0.qdb
├── _lib1_0.qpg
├── _lib1_0.qtl
├── _lib.qdb
└── _vmake
32 directories, 518 files
FPGA中主要模块包含：时钟模块、OV7670初始化模块、DVP协议数据流模块、写FIFO模块、写FIFO控制模块、SDRAM控制模块、读FIFO模块、读FIFO控制模块、VGA控制模块。 其中OV7670初始化模块、DVP协议数据流模块和VGA控制模块都在本专题博客中写过，这里不再赘述。写FIFO和读FIFO模块使用的IP核，都是宽度16位，长度256，其中读FIFO使用的是showahead模式。SDRAM控制器漆面的博客也写过，这边做了一些改动，添加了一些需要的信号。 其整体流程为：启动时先对摄像头进行初始化设置，初始化完成后，FPGA从摄像头获取一帧一帧的图像数据，根据数
【实例截图】
【核心代码】
4744300845370645736.zip
└── camera_ov7670
├── doc
│ └── 绘图1.vsdx
├── img
│ ├── 1.jpg
│ ├── 2.jpg
│ ├── 3.jpg
│ ├── 4.jpg
│ └── 整体系统框图.png
├── prj
│ ├── camera_ov7670.ipregen.rpt
│ ├── camera_ov7670_nativelink_simulation.rpt
│ ├── camera_ov7670.qpf
│ ├── camera_ov7670.qsf
│ ├── camera_ov7670.qws
│ ├── db
│ │ ├── a_gray2bin_ugb.tdf
│ │ ├── a_graycounter_n5c.tdf
│ │ ├── a_graycounter_pjc.tdf
│ │ ├── a_graycounter_rn6.tdf
│ │ ├── a_graycounter_t57.tdf
│ │ ├── alt_synch_pipe_0ol.tdf
│ │ ├── alt_synch_pipe_1ol.tdf
│ │ ├── alt_synch_pipe_2ol.tdf
│ │ ├── alt_synch_pipe_3ol.tdf
│ │ ├── alt_synch_pipe_h9l.tdf
│ │ ├── alt_synch_pipe_i9l.tdf
│ │ ├── altsyncram_0b24.tdf
│ │ ├── altsyncram_1b24.tdf
│ │ ├── altsyncram_6d24.tdf
│ │ ├── altsyncram_do41.tdf
│ │ ├── altsyncram_ga24.tdf
│ │ ├── altsyncram_ia24.tdf
│ │ ├── altsyncram_id24.tdf
│ │ ├── altsyncram_ka24.tdf
│ │ ├── altsyncram_kd24.tdf
│ │ ├── altsyncram_la24.tdf
│ │ ├── altsyncram_ld24.tdf
│ │ ├── altsyncram_ma24.tdf
│ │ ├── altsyncram_mv61.tdf
│ │ ├── altsyncram_na24.tdf
│ │ ├── altsyncram_oa24.tdf
│ │ ├── altsyncram_p421.tdf
│ │ ├── altsyncram_qa24.tdf
│ │ ├── altsyncram_ra24.tdf
│ │ ├── altsyncram_sa24.tdf
│ │ ├── altsyncram_ua24.tdf
│ │ ├── altsyncram_va24.tdf
│ │ ├── camera_ov7670.(0).cnf.cdb
│ │ ├── camera_ov7670.(0).cnf.hdb
│ │ ├── camera_ov7670.(10).cnf.cdb
│ │ ├── camera_ov7670.(10).cnf.hdb
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│ │ ├── camera_ov7670.(11).cnf.hdb
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│ │ ├── camera_ov7670.(39).cnf.cdb
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│ │ ├── camera_ov7670.(50).cnf.cdb
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│ │ ├── camera_ov7670.(5).cnf.cdb
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│ │ ├── camera_ov7670.(9).cnf.hdb
│ │ ├── camera_ov7670.asm_labs.ddb
│ │ ├── camera_ov7670.asm.qmsg
│ │ ├── camera_ov7670.asm.rdb
│ │ ├── camera_ov7670.autoh_e40e1.map.reg_db.cdb
│ │ ├── camera_ov7670.autos_3e921.map.reg_db.cdb
│ │ ├── camera_ov7670.cbx.xml
│ │ ├── camera_ov7670.cmp.bpm
│ │ ├── camera_ov7670.cmp.cdb
│ │ ├── camera_ov7670.cmp.hdb
│ │ ├── camera_ov7670.cmp.idb
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│ │ ├── camera_ov7670.cmp_merge.kpt
│ │ ├── camera_ov7670.cmp.rdb
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│ │ ├── camera_ov7670.eda.qmsg
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│ │ ├── camera_ov7670.sld_design_entry.sci
│ │ ├── camera_ov7670.smart_action.txt
│ │ ├── camera_ov7670.smp_dump.txt
│ │ ├── camera_ov7670.sta_cmp.8_slow_1200mv_85c.tdb
│ │ ├── camera_ov7670.sta.qmsg
│ │ ├── camera_ov7670.sta.rdb
│ │ ├── camera_ov7670.tiscmp.fast_1200mv_0c.ddb
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│ │ ├── camera_ov7670.tiscmp.fastest_slow_1200mv_85c.ddb
│ │ ├── camera_ov7670.tiscmp.slow_1200mv_0c.ddb
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│ │ ├── camera_ov7670.tis_db_list.ddb
│ │ ├── camera_ov7670.vpr.ammdb
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│ │ │ ├── alt_sld_fab_alt_sld_fab_ident.sv
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│ │ │ ├── alt_sld_fab_alt_sld_fab_sldfabric.vhd
│ │ │ ├── alt_sld_fab_alt_sld_fab_splitter.sv
│ │ │ └── alt_sld_fab_alt_sld_fab.v
│ │ ├── mux_psc.tdf
│ │ ├── pll_altpll.v
│ │ ├── prev_cmp_camera_ov7670.qmsg
│ │ └── stp1_auto_stripped.stp
│ ├── greybox_tmp
│ │ └── cbx_args.txt
│ ├── incremental_db
│ │ ├── compiled_partitions
│ │ │ ├── camera_ov7670.autoh_e40e1.cmp.ammdb
│ │ │ ├── camera_ov7670.autoh_e40e1.cmp.cdb
│ │ │ ├── camera_ov7670.autoh_e40e1.cmp.dfp
│ │ │ ├── camera_ov7670.autoh_e40e1.cmp.hdb
│ │ │ ├── camera_ov7670.autoh_e40e1.cmp.logdb
│ │ │ ├── camera_ov7670.autoh_e40e1.cmp.rcfdb
│ │ │ ├── camera_ov7670.autoh_e40e1.map.cdb
│ │ │ ├── camera_ov7670.autoh_e40e1.map.dpi
│ │ │ ├── camera_ov7670.autoh_e40e1.map.hdb
│ │ │ ├── camera_ov7670.autoh_e40e1.map.kpt
│ │ │ ├── camera_ov7670.autoh_e40e1.map.logdb
│ │ │ ├── camera_ov7670.autos_3e921.cmp.ammdb
│ │ │ ├── camera_ov7670.autos_3e921.cmp.cdb
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│ │ │ ├── camera_ov7670.autos_3e921.cmp.hdb
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│ │ │ ├── camera_ov7670.db_info
│ │ │ ├── camera_ov7670.root_partition.cmp.ammdb
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│ │ │ ├── camera_ov7670.root_partition.map.cdb
│ │ │ ├── camera_ov7670.root_partition.map.dpi
│ │ │ ├── camera_ov7670.root_partition.map.hbdb.cdb
│ │ │ ├── camera_ov7670.root_partition.map.hbdb.hb_info
│ │ │ ├── camera_ov7670.root_partition.map.hbdb.hdb
│ │ │ ├── camera_ov7670.root_partition.map.hbdb.sig
│ │ │ ├── camera_ov7670.root_partition.map.hdb
│ │ │ ├── camera_ov7670.root_partition.map.kpt
│ │ │ └── camera_ov7670.rrp.hdb
│ │ └── README
│ ├── output_files
│ │ ├── camera_ov7670.asm.rpt
│ │ ├── camera_ov7670.done
│ │ ├── camera_ov7670.eda.rpt
│ │ ├── camera_ov7670.fit.rpt
│ │ ├── camera_ov7670.fit.smsg
│ │ ├── camera_ov7670.fit.summary
│ │ ├── camera_ov7670.flow.rpt
│ │ ├── camera_ov7670.jdi
│ │ ├── camera_ov7670.map.rpt
│ │ ├── camera_ov7670.map.summary
│ │ ├── camera_ov7670.pin
│ │ ├── camera_ov7670.sld
│ │ ├── camera_ov7670.sof
│ │ ├── camera_ov7670.sta.rpt
│ │ ├── camera_ov7670.sta.summary
│ │ └── stp1.stp
│ └── simulation
│ └── modelsim
│ ├── camera_ov7670_8_1200mv_0c_slow.vo
│ ├── camera_ov7670_8_1200mv_0c_v_slow.sdo
│ ├── camera_ov7670_8_1200mv_85c_slow.vo
│ ├── camera_ov7670_8_1200mv_85c_v_slow.sdo
│ ├── camera_ov7670_min_1200mv_0c_fast.vo
│ ├── camera_ov7670_min_1200mv_0c_v_fast.sdo
│ ├── camera_ov7670_modelsim.xrf
│ ├── camera_ov7670_run_msim_rtl_verilog.do
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak1
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak2
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak3
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak4
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│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak7
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak8
│ ├── camera_ov7670_run_msim_rtl_verilog.do.bak9
│ ├── camera_ov7670.sft
│ ├── camera_ov7670.vo
│ ├── camera_ov7670_v.sdo
│ ├── modelsim.ini
│ ├── msim_transcript
│ ├── rtl_work
│ │ ├── _info
│ │ ├── _lib1_4.qdb
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│ │ ├── _lib.qdb
│ │ └── _vmake
│ ├── verilog_libs
│ │ ├── altera_lnsim_ver
│ │ │ ├── _info
│ │ │ ├── _lib1_9.qdb
│ │ │ ├── _lib1_9.qpg
│ │ │ ├── _lib1_9.qtl
│ │ │ ├── _lib.qdb
│ │ │ └── _vmake
│ │ ├── altera_mf_ver
│ │ │ ├── _info
│ │ │ ├── _lib1_9.qdb
│ │ │ ├── _lib1_9.qpg
│ │ │ ├── _lib1_9.qtl
│ │ │ ├── _lib.qdb
│ │ │ └── _vmake
│ │ ├── altera_ver
│ │ │ ├── _info
│ │ │ ├── _lib1_9.qdb
│ │ │ ├── _lib1_9.qpg
│ │ │ ├── _lib1_9.qtl
│ │ │ ├── _lib.qdb
│ │ │ └── _vmake
│ │ ├── cycloneive_ver
│ │ │ ├── _info
│ │ │ ├── _lib1_9.qdb
│ │ │ ├── _lib1_9.qpg
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│ │ │ ├── _lib.qdb
│ │ │ └── _vmake
│ │ ├── lpm_ver
│ │ │ ├── _info
│ │ │ ├── _lib1_9.qdb
│ │ │ ├── _lib1_9.qpg
│ │ │ ├── _lib1_9.qtl
│ │ │ ├── _lib.qdb
│ │ │ └── _vmake
│ │ └── sgate_ver
│ │ ├── _info
│ │ ├── _lib1_9.qdb
│ │ ├── _lib1_9.qpg
│ │ ├── _lib1_9.qtl
│ │ ├── _lib.qdb
│ │ └── _vmake
│ ├── vsim.wlf
│ └── wlft2x25cx
├── rtl
│ ├── camera_ov7670_top_tb.v
│ ├── camera_ov7670_top.v
│ ├── camera_ov7670_top.v.bak
│ ├── IP_FIFO
│ │ ├── async_fifo_bb.v
│ │ ├── async_fifo_inst.v
│ │ ├── async_fifo.qip
│ │ ├── async_fifo_tb.v
│ │ └── async_fifo.v
│ ├── IP_FIFO_AHEAD
│ │ ├── async_fifo_ahead_bb.v
│ │ ├── async_fifo_ahead_inst.v
│ │ ├── async_fifo_ahead.qip
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│ │ ├── async_fifo_ahead_tb.v.bak
│ │ └── async_fifo_ahead.v
│ ├── IP_PLL
│ │ ├── pll_bb.v
│ │ ├── pll_inst.v
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│ │ ├── pll.qip
│ │ └── pll.v
│ ├── ov7670_config.v
│ ├── ov7670_data_16rgb565.v
│ ├── ov7670_init.v
│ ├── rd_control.v
│ ├── rd_control.v.bak
│ ├── SCCB_sender.v
│ ├── SDRAM_control.v
│ ├── SDRAM_control.v.bak
│ ├── VGA_ctrl.v
│ ├── work
│ │ ├── _info
│ │ ├── _lib1_0.qdb
│ │ ├── _lib1_0.qpg
│ │ ├── _lib1_0.qtl
│ │ ├── _lib.qdb
│ │ └── _vmake
│ ├── wr_control.v
│ └── wr_control.v.bak
└── sim
├── sdram_sim
│ ├── 111.cr.mti
│ ├── 111.mpf
│ ├── async_fifo_ahead.v
│ ├── async_fifo.v
│ ├── pll.v
│ ├── rd_control.v
│ ├── SDRAM_control_test_tb.v
│ ├── SDRAM_control_test_tb.v.bak
│ ├── SDRAM_control_test.v
│ ├── SDRAM_control_test.v.bak
│ ├── SDRAM_control.v
│ ├── sdram_model_plus.v
│ ├── vsim.wlf
│ ├── work
│ │ ├── _info
│ │ ├── _lib1_7.qdb
│ │ ├── _lib1_7.qpg
│ │ ├── _lib1_7.qtl
│ │ ├── _lib1_8.qdb
│ │ ├── _lib1_8.qpg
│ │ ├── _lib1_8.qtl
│ │ ├── _lib.qdb
│ │ └── _vmake
│ └── wr_control.v
└── sim1
├── 111.cr.mti
├── 111.mpf
├── transcript
├── vsim.wlf
└── work
├── _info
├── _lib1_0.qdb
├── _lib1_0.qpg
├── _lib1_0.qtl
├── _lib.qdb
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