实例介绍
【实例简介】
基于hdl设计的lvds接口代码
【实例截图】
【源码目录】
lvds
├── doc
│ ├── LVDS Owner's Manual - Low-Voltage Differential Signaling (PDF).pdf
│ ├── Xilinx_FPGA中LVDS差分高速传输的实现.doc
│ └── xapp622.pdf
├── oth
│ ├── 7_1LVDS_serilizer.v
│ └── io_lvds_synopsys.v
├── rx_sdr_16d_4to1_left.v
├── rx_sdr_16d_4to1_right.v
├── sim
│ ├── filelist.v
│ ├── r
│ ├── test.mpf
│ ├── testbench(OLD).v
│ ├── testbench.v
│ └── work
│ ├── _info
│ ├── _lib.qdb
│ ├── _lib1_2.qdb
│ ├── _lib1_2.qpg
│ ├── _lib1_2.qtl
│ └── _vmake
├── top_left.v
├── top_right.v
├── top_xlvds.v
├── tx_clocks.v
├── tx_sdr_16d_4to1_left.v
├── tx_sdr_16d_4to1_right.v
└── xdc
├── par_v2p_right_top - 副本.ucf
├── par_v2p_right_top.ucf
├── par_v2p_xlvds - 副本.ucf
├── par_v2p_xlvds.ucf
├── v2p_left_top.ucf
├── 新建文本文档 - 副本.txt
└── 新建文本文档.txt
5 directories, 31 files
【核心代码】
rx_sdr_16d_4to1_left U_rx (
.RXP_data( RXP_data ),
.RXN_data( RXN_data ),
.REFCLK ( REFCLK_in_p),
.RX_sync ( RX_clk_i ),
.SYSCLK ( CLK_qdr ),
.RST ( RST_i ),
.RE ( has_data ),
.DATA ( RX_data ),
.BUFSTAT ( RX_bufstat ),
.CLK_qdr ( ),
.READY ( RX_ready )
);
tx_clocks U_txclk(
.REFCLK_p ( REFCLK_in_p ),
.REFCLK_n ( REFCLK_in_n ),
.RST ( RST_i ),
.CLK_sdr_p( CLK_sdr_p ),
.CLK_sdr_n( CLK_sdr_n ),
.CLK_qdr ( CLK_qdr ),
.LOCK ( TX_ready ));
tx_sdr_16d_4to1_right U_tx (
.DATA ( TX_data ),
.CLK_sdr_p( CLK_sdr_p ),
.CLK_sdr_n( CLK_sdr_n ),
.CLK_qdr ( CLK_qdr ),
.TXP_data ( TXP_data ),
.TXN_data ( TXN_data ),
.TXP_clk ( TXP_clk ),
.TXN_clk ( TXN_clk )
);
OBUF OB_rxready (.I(RX_ready), .O(RX_ready_out));
OBUF OB_txready (.I(TX_ready), .O(TX_ready_out));
标签: 仿真
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