实例介绍
cy68013A USB高速数据采集的FPGA程序源码
【实例截图】
【核心代码】
usb
└── usb
├── 写FIFO
│ ├── Apptest
│ │ ├── ezusbsys.h
│ │ ├── ReadMe.txt
│ │ ├── Release
│ │ │ ├── 10-24-19-34-40.bin
│ │ │ ├── StdAfx.obj
│ │ │ ├── TestDlg.obj
│ │ │ ├── Test.exe
│ │ │ ├── Test.obj
│ │ │ ├── Test.res
│ │ │ └── vc60.idb
│ │ ├── Release写fifo.rar
│ │ ├── res
│ │ │ ├── cursor1.cur
│ │ │ ├── icon5.ico
│ │ │ ├── Test.ico
│ │ │ ├── Test.rc2
│ │ │ └── usb.ico
│ │ ├── Resource.h
│ │ ├── StdAfx.cpp
│ │ ├── StdAfx.h
│ │ ├── Test.aps
│ │ ├── Test.clw
│ │ ├── Test.cpp
│ │ ├── TestDlg.cpp
│ │ ├── TestDlg.h
│ │ ├── Test.dsp
│ │ ├── Test.dsw
│ │ ├── Test.h
│ │ ├── Test.ncb
│ │ ├── Test.opt
│ │ ├── Test.plg
│ │ └── Test.rc
│ └── wr_fifo
│ ├── incremental_db
│ │ ├── compiled_partitions
│ │ │ ├── wr_fifo.root_partition.cmp.atm
│ │ │ ├── wr_fifo.root_partition.cmp.dfp
│ │ │ ├── wr_fifo.root_partition.cmp.hdbx
│ │ │ ├── wr_fifo.root_partition.cmp.kpt
│ │ │ ├── wr_fifo.root_partition.cmp.logdb
│ │ │ ├── wr_fifo.root_partition.cmp.rcf
│ │ │ ├── wr_fifo.root_partition.map.atm
│ │ │ ├── wr_fifo.root_partition.map.dpi
│ │ │ ├── wr_fifo.root_partition.map.hdbx
│ │ │ └── wr_fifo.root_partition.map.kpt
│ │ └── README
│ ├── wr_fifo.asm.rpt
│ ├── wr_fifo.done
│ ├── wr_fifo.dpf
│ ├── wr_fifo.fit.rpt
│ ├── wr_fifo.fit.smsg
│ ├── wr_fifo.fit.summary
│ ├── wr_fifo.flow.rpt
│ ├── wr_fifo.map.rpt
│ ├── wr_fifo.map.summary
│ ├── wr_fifo.pin
│ ├── wr_fifo.qpf
│ ├── wr_fifo.qsf
│ ├── wr_fifo.qws
│ ├── wr_fifo.sof
│ ├── wr_fifo.sta.rpt
│ ├── wr_fifo.sta.summary
│ ├── wr_fifo.v
│ └── wr_fifo.v.bak
└── 读FIFO
├── Apptest
│ ├── ezusbsys.h
│ ├── ReadMe.txt
│ ├── Release
│ │ ├── StdAfx.obj
│ │ ├── TestDlg.obj
│ │ ├── Test.exe
│ │ ├── Test.obj
│ │ ├── Test.res
│ │ └── vc60.idb
│ ├── res
│ │ ├── cursor1.cur
│ │ ├── icon5.ico
│ │ ├── Test.ico
│ │ ├── Test.rc2
│ │ ├── Thumbs.db
│ │ └── usb.ico
│ ├── Resource.h
│ ├── StdAfx.cpp
│ ├── StdAfx.h
│ ├── Test.aps
│ ├── Test.clw
│ ├── Test.cpp
│ ├── TestDlg.cpp
│ ├── TestDlg.h
│ ├── Test.dsp
│ ├── Test.dsw
│ ├── Test.h
│ ├── Test.ncb
│ ├── Test.opt
│ ├── Test.plg
│ └── Test.rc
└── rd_fifo
├── asyn_rd.asm.rpt
├── asyn_rd_assignment_defaults.qdf
├── asyn_rd.cdf
├── asyn_rd.cr.mti
├── asyn_rd.done
├── asyn_rd.dpf
├── asyn_rd.fit.eqn
├── asyn_rd.fit.rpt
├── asyn_rd.fit.smsg
├── asyn_rd.fit.summary
├── asyn_rd.flow.rpt
├── asyn_rd.jdi
├── asyn_rd.map.eqn
├── asyn_rd.map.rpt
├── asyn_rd.map.summary
├── asyn_rd.mpf
├── asyn_rd.pin
├── asyn_rd.pof
├── asyn_rd.qpf
├── asyn_rd.qsf
├── asyn_rd.qws
├── asyn_rd.sim.rpt
├── asyn_rd.sof
├── asyn_rd.sta.rpt
├── asyn_rd.sta.summary
├── asyn_rd.tan.rpt
├── asyn_rd.tan.summary
├── asyn_rd_tb.v
├── asyn_rd.v
├── asyn_rd.v.bak
├── asyn_rd.vwf
├── cmp_state.ini
├── incremental_db
│ ├── compiled_partitions
│ │ └── asyn_rd.root_partition.map.kpt
│ └── README
├── sim.cfg
├── stp2.stp
├── transcript
├── vish_stacktrace.vstf
├── vsim.wlf
└── work
├── asyn_rd
│ ├── _primary.dat
│ ├── _primary.vhd
│ └── verilog.asm
├── asyn_rd_tb
│ ├── _primary.dat
│ ├── _primary.vhd
│ └── verilog.asm
└── _info
18 directories, 134 files
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