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FPGA+USB68013+SLAVEFIFO+SDRAM+FIFO

一般编程问题

下载此实例
  • 开发语言:Others
  • 实例大小:3.00M
  • 下载次数:10
  • 浏览次数:135
  • 发布时间:2020-10-19
  • 实例类别:一般编程问题
  • 发 布 人:robot666
  • 文件格式:.rar
  • 所需积分:2
 

实例介绍

【实例简介】
FPGA USB68013 以slavefifo读写sdram——fifo,在硬件平台以实现,altera环境,verilog语言
【实例截图】
【核心代码】
SourceCode27_SLAVE_FIFO16模式读SDRAM_FIFO
└── SourceCode27_SLAVE_FIFO16模式读SDRAM_FIFO
├── FPGA_SourceCode
│   ├── atom_netlists
│   │   └── MYFX2.qsf
│   ├── Chain1.cdf
│   ├── cmp_state.ini
│   ├── db
│   │   ├── a_dpfifo_mg31.tdf
│   │   ├── a_dpfifo_sj31.tdf
│   │   ├── a_fefifo_4be.tdf
│   │   ├── a_gray2bin_kdb.tdf
│   │   ├── a_gray2bin_ldb.tdf
│   │   ├── a_gray2bin_mdb.tdf
│   │   ├── a_graycounter_egc.tdf
│   │   ├── a_graycounter_fgc.tdf
│   │   ├── a_graycounter_ggc.tdf
│   │   ├── a_graycounter_hgc.tdf
│   │   ├── a_graycounter_igc.tdf
│   │   ├── a_graycounter_jgc.tdf
│   │   ├── a_graycounter_o96.tdf
│   │   ├── a_graycounter_p96.tdf
│   │   ├── a_graycounter_q96.tdf
│   │   ├── alt_synch_pipe_0e8.tdf
│   │   ├── alt_synch_pipe_1e8.tdf
│   │   ├── alt_synch_pipe_2e8.tdf
│   │   ├── alt_synch_pipe_3e8.tdf
│   │   ├── alt_synch_pipe_4e8.tdf
│   │   ├── alt_synch_pipe_5e8.tdf
│   │   ├── alt_synch_pipe_6e8.tdf
│   │   ├── alt_synch_pipe_7e8.tdf
│   │   ├── alt_synch_pipe_8e8.tdf
│   │   ├── alt_synch_pipe_9e8.tdf
│   │   ├── alt_synch_pipe_ae8.tdf
│   │   ├── alt_synch_pipe_be8.tdf
│   │   ├── alt_synch_pipe_ce8.tdf
│   │   ├── alt_synch_pipe_de8.tdf
│   │   ├── alt_synch_pipe_ee8.tdf
│   │   ├── alt_synch_pipe_fe8.tdf
│   │   ├── alt_synch_pipe_ge8.tdf
│   │   ├── alt_synch_pipe_he8.tdf
│   │   ├── alt_synch_pipe_ie8.tdf
│   │   ├── alt_synch_pipe_je8.tdf
│   │   ├── alt_synch_pipe_ke8.tdf
│   │   ├── alt_synch_pipe_le8.tdf
│   │   ├── alt_synch_pipe_me8.tdf
│   │   ├── alt_synch_pipe_ne8.tdf
│   │   ├── alt_synch_pipe_rdb.tdf
│   │   ├── alt_synch_pipe_ud8.tdf
│   │   ├── alt_synch_pipe_vd8.tdf
│   │   ├── altsyncram_02k1.tdf
│   │   ├── altsyncram_1l81.tdf
│   │   ├── altsyncram_1sc1.tdf
│   │   ├── altsyncram_3731.tdf
│   │   ├── altsyncram_3fb1.tdf
│   │   ├── altsyncram_akj1.tdf
│   │   ├── altsyncram_drg1.tdf
│   │   ├── altsyncram_f3e1.tdf
│   │   ├── altsyncram_j931.tdf
│   │   ├── altsyncram_l931.tdf
│   │   ├── altsyncram_ni01.tdf
│   │   ├── altsyncram_t3s1.tdf
│   │   ├── altsyncram_ttg1.tdf
│   │   ├── altsyncram_vtg1.tdf
│   │   ├── cmpr_p16.tdf
│   │   ├── cntr_7l7.tdf
│   │   ├── cntr_9l7.tdf
│   │   ├── cntr_qkb.tdf
│   │   ├── cntr_rkb.tdf
│   │   ├── cntr_tkb.tdf
│   │   ├── dcfifo_04o1.tdf
│   │   ├── dcfifo_18o1.tdf
│   │   ├── dcfifo_58o1.tdf
│   │   ├── dcfifo_64o1.tdf
│   │   ├── dcfifo_6bo1.tdf
│   │   ├── dcfifo_75o1.tdf
│   │   ├── dcfifo_e8o1.tdf
│   │   ├── dcfifo_efp1.tdf
│   │   ├── dcfifo_enm1.tdf
│   │   ├── dcfifo_s6o1.tdf
│   │   ├── dcfifo_t7o1.tdf
│   │   ├── dcfifo_u3o1.tdf
│   │   ├── dcfifo_u6o1.tdf
│   │   ├── dcfifo_v7o1.tdf
│   │   ├── decode_o37.tdf
│   │   ├── dffpipe_0f9.tdf
│   │   ├── dffpipe_1f9.tdf
│   │   ├── dffpipe_2f9.tdf
│   │   ├── dffpipe_3f9.tdf
│   │   ├── dffpipe_4f9.tdf
│   │   ├── dffpipe_5f9.tdf
│   │   ├── dffpipe_6f9.tdf
│   │   ├── dffpipe_7f9.tdf
│   │   ├── dffpipe_8f9.tdf
│   │   ├── dffpipe_9d9.tdf
│   │   ├── dffpipe_9f9.tdf
│   │   ├── dffpipe_af9.tdf
│   │   ├── dffpipe_ahe.tdf
│   │   ├── dffpipe_bf9.tdf
│   │   ├── dffpipe_cf9.tdf
│   │   ├── dffpipe_df9.tdf
│   │   ├── dffpipe_ef9.tdf
│   │   ├── dffpipe_ff9.tdf
│   │   ├── dffpipe_gf9.tdf
│   │   ├── dffpipe_hf9.tdf
│   │   ├── dffpipe_if9.tdf
│   │   ├── dffpipe_jf9.tdf
│   │   ├── dffpipe_kec.tdf
│   │   ├── dffpipe_kf9.tdf
│   │   ├── dffpipe_mcc.tdf
│   │   ├── dffpipe_oe9.tdf
│   │   ├── dffpipe_pe9.tdf
│   │   ├── dffpipe_qe9.tdf
│   │   ├── dffpipe_re9.tdf
│   │   ├── dffpipe_se9.tdf
│   │   ├── dffpipe_te9.tdf
│   │   ├── dffpipe_ue9.tdf
│   │   ├── dffpipe_ve9.tdf
│   │   ├── dpram_r011.tdf
│   │   ├── mux_1u7.tdf
│   │   ├── mux_nv7.tdf
│   │   ├── MYFX2.(0).cnf.cdb
│   │   ├── MYFX2.(0).cnf.hdb
│   │   ├── MYFX2.(10).cnf.cdb
│   │   ├── MYFX2.(10).cnf.hdb
│   │   ├── MYFX2.(11).cnf.cdb
│   │   ├── MYFX2.(11).cnf.hdb
│   │   ├── MYFX2.(12).cnf.cdb
│   │   ├── MYFX2.(12).cnf.hdb
│   │   ├── MYFX2.(13).cnf.cdb
│   │   ├── MYFX2.(13).cnf.hdb
│   │   ├── MYFX2.(14).cnf.cdb
│   │   ├── MYFX2.(14).cnf.hdb
│   │   ├── MYFX2.(15).cnf.cdb
│   │   ├── MYFX2.(15).cnf.hdb
│   │   ├── MYFX2.(16).cnf.cdb
│   │   ├── MYFX2.(16).cnf.hdb
│   │   ├── MYFX2.(17).cnf.cdb
│   │   ├── MYFX2.(17).cnf.hdb
│   │   ├── MYFX2.(18).cnf.cdb
│   │   ├── MYFX2.(18).cnf.hdb
│   │   ├── MYFX2.(19).cnf.cdb
│   │   ├── MYFX2.(19).cnf.hdb
│   │   ├── MYFX2.(1).cnf.cdb
│   │   ├── MYFX2.(1).cnf.hdb
│   │   ├── MYFX2.(20).cnf.cdb
│   │   ├── MYFX2.(20).cnf.hdb
│   │   ├── MYFX2.(21).cnf.cdb
│   │   ├── MYFX2.(21).cnf.hdb
│   │   ├── MYFX2.(22).cnf.cdb
│   │   ├── MYFX2.(22).cnf.hdb
│   │   ├── MYFX2.(23).cnf.cdb
│   │   ├── MYFX2.(23).cnf.hdb
│   │   ├── MYFX2.(24).cnf.cdb
│   │   ├── MYFX2.(24).cnf.hdb
│   │   ├── MYFX2.(25).cnf.cdb
│   │   ├── MYFX2.(25).cnf.hdb
│   │   ├── MYFX2.(26).cnf.cdb
│   │   ├── MYFX2.(26).cnf.hdb
│   │   ├── MYFX2.(2).cnf.cdb
│   │   ├── MYFX2.(2).cnf.hdb
│   │   ├── MYFX2.(3).cnf.cdb
│   │   ├── MYFX2.(3).cnf.hdb
│   │   ├── MYFX2.(4).cnf.cdb
│   │   ├── MYFX2.(4).cnf.hdb
│   │   ├── MYFX2.(5).cnf.cdb
│   │   ├── MYFX2.(5).cnf.hdb
│   │   ├── MYFX2.(6).cnf.cdb
│   │   ├── MYFX2.(6).cnf.hdb
│   │   ├── MYFX2.(7).cnf.cdb
│   │   ├── MYFX2.(7).cnf.hdb
│   │   ├── MYFX2.(8).cnf.cdb
│   │   ├── MYFX2.(8).cnf.hdb
│   │   ├── MYFX2.(9).cnf.cdb
│   │   ├── MYFX2.(9).cnf.hdb
│   │   ├── MYFX2.ace_cmp.cdb
│   │   ├── MYFX2.ace_cmp.hdb
│   │   ├── MYFX2.asm_labs.ddb
│   │   ├── MYFX2.asm.qmsg
│   │   ├── MYFX2.cbx.xml
│   │   ├── MYFX2.cmp0.ddb
│   │   ├── MYFX2.cmp1.ddb
│   │   ├── MYFX2.cmp2.ddb
│   │   ├── MYFX2.cmp.cdb
│   │   ├── MYFX2.cmp.hdb
│   │   ├── MYFX2.cmp.kpt
│   │   ├── MYFX2.cmp.logdb
│   │   ├── MYFX2_cmp.qrpt
│   │   ├── MYFX2.cmp.rdb
│   │   ├── MYFX2.cmp.tdb
│   │   ├── MYFX2.db_info
│   │   ├── MYFX2.eco.cdb
│   │   ├── MYFX2.fit.qmsg
│   │   ├── MYFX2.hier_info
│   │   ├── MYFX2.hif
│   │   ├── MYFX2.lfp.cdb
│   │   ├── MYFX2.map.cdb
│   │   ├── MYFX2.map.hdb
│   │   ├── MYFX2.map.logdb
│   │   ├── MYFX2.map.qmsg
│   │   ├── MYFX2.pre_map.cdb
│   │   ├── MYFX2.pre_map.hdb
│   │   ├── MYFX2.rtlv.hdb
│   │   ├── MYFX2.rtlv_sg.cdb
│   │   ├── MYFX2.rtlv_sg_swap.cdb
│   │   ├── MYFX2.sgdiff.cdb
│   │   ├── MYFX2.sgdiff.hdb
│   │   ├── MYFX2.sld_design_entry_dsc.sci
│   │   ├── MYFX2.sld_design_entry.sci
│   │   ├── MYFX2.syn_hier_info
│   │   ├── MYFX2.tan.qmsg
│   │   ├── MYFX2.tis_db_list.ddb
│   │   ├── prev_cmp_MYFX2.asm.qmsg
│   │   ├── prev_cmp_MYFX2.fit.qmsg
│   │   ├── prev_cmp_MYFX2.map.qmsg
│   │   ├── prev_cmp_MYFX2.qmsg
│   │   ├── prev_cmp_MYFX2.tan.qmsg
│   │   ├── scfifo_fa31.tdf
│   │   └── scfifo_ld31.tdf
│   ├── incremental_db
│   │   ├── compiled_partitions
│   │   │   └── MYFX2.root_partition.map.kpt
│   │   └── README
│   ├── MYFX2.asm.rpt
│   ├── MYFX2_assignment_defaults.qdf
│   ├── MYFX2.cdf
│   ├── MYFX2.done
│   ├── MYFX2.dpf
│   ├── MYFX2.fit.eqn
│   ├── MYFX2.fit.rpt
│   ├── MYFX2.fit.smsg
│   ├── MYFX2.fit.summary
│   ├── MYFX2.fld
│   ├── MYFX2.flow.rpt
│   ├── MYFX2.map.eqn
│   ├── MYFX2.map.rpt
│   ├── MYFX2.map.smsg
│   ├── MYFX2.map.summary
│   ├── MYFX2.out.sdc
│   ├── MYFX2.pin
│   ├── MYFX2.pof
│   ├── MYFX2.qpf
│   ├── MYFX2.qsf
│   ├── MYFX2.qws
│   ├── MYFX2.sdc
│   ├── MYFX2.sof
│   ├── MYFX2.tan.rpt
│   ├── MYFX2.tan.summary
│   ├── MYFX2.tcl
│   ├── MYFX2.v
│   ├── MYFX2.v.bak
│   ├── MySRAM.bsf
│   ├── MySRAM.v
│   ├── MySRAM_wave0.jpg
│   ├── MySRAM_wave1.jpg
│   ├── MySRAM_waveforms.html
│   ├── Reset_Delay.v
│   ├── Reset_Delay.v.bak
│   ├── Sdram_Control_4Port
│   │   ├── command.v
│   │   ├── control_interface.v
│   │   ├── Sdram_Control_4Port.v
│   │   ├── Sdram_Control_4Port.v.bak
│   │   ├── Sdram_FIFO_bb.v
│   │   ├── Sdram_FIFO.bsf
│   │   ├── Sdram_FIFO_inst.v
│   │   ├── Sdram_FIFO.v
│   │   ├── Sdram_FIFO_wave0.jpg
│   │   ├── Sdram_FIFO_wave1.jpg
│   │   ├── Sdram_FIFO_waveforms.html
│   │   ├── Sdram_Params.h
│   │   ├── Sdram_Params.h.bak
│   │   ├── Sdram_PLL.bsf
│   │   ├── Sdram_PLL.ppf
│   │   ├── Sdram_PLL.v
│   │   ├── Sdram_PLL_wave0.jpg
│   │   ├── Sdram_PLL_waveforms.html
│   │   └── sdr_data_path.v
│   └── transcript
└── USB_Firmware
├── build.bat
├── dscr.a51
├── DSCR.LST
├── DSCR.OBJ
├── Ezusb.lib
├── fw.c
├── FW.LST
├── FW.OBJ
├── readme.txt
├── tcxmaster
├── tcxmaster.c
├── tcxmaster.hex
├── tcxmaster.iic
├── tcxmaster.lnp
├── tcxmaster.LST
├── tcxmaster.M51
├── tcxmaster.OBJ
├── tcxmaster.Opt
├── tcxmaster_Opt.Bak
├── tcxmaster.plg
├── tcxmaster.Uv2
├── tcxmaster_Uv2.Bak
└── USBJmpTb.OBJ

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FPGA+USB68013+SLAVEFIFO+SDRAM+FIFO

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