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基于FPGA的数字频率计设计

一般编程问题

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  • 开发语言:Others
  • 实例大小:0.12M
  • 下载次数:7
  • 浏览次数:100
  • 发布时间:2020-07-29
  • 实例类别:一般编程问题
  • 发 布 人:robot666
  • 文件格式:
  • 所需积分:2
 

实例介绍

【实例简介】
本文要设计一个8位十进制数字频率计,需要由四种器件来组成,即:测频控制信号发生器(FTCTRL)、有时钟使能的十进制计数器(CNT10)、32位锁存器(REG32B)、除法器模块(division). 因为是8位十进制数字频率计,所以计数器CNT10需用8个,7段显示LED7也需用8个. 频率测量的基本原理是计算每秒钟内待测信号的脉冲个数。 为此,测频控制信号发生器FTCTRL应设置一个控制信号时钟CLKK,一个计数使能信号输出端CNT_EN、一个与CNT_EN输出信号反向的锁存输出信号Load、和清零输出信号RST_CNT。 如CLKK的输入频率为1HZ,则输出信号端CNT_EN输出一个脉宽
【实例截图】
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基于FPGA的数字频率计设计

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