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【核心代码】

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1 系统和存储器 24
1.1 概述 24
1.2 主要特性 24
1.3 功能描述 26
1.3.1 地址映射 26
1.3.2 片上存储器 26
1.3.2.1 Internal ROM 0 27
1.3.2.2 Internal ROM 1 27
1.3.2.3 Internal SRAM 0 27
1.3.2.4 Internal SRAM 1 28
1.3.2.5 Internal SRAM 2 28
1.3.2.6 DMA 28
1.3.2.7 RTC FAST Memory 29
1.3.2.8 RTC SLOW Memory 29
1.3.3 片外存储器 29
1.3.4 Cache 29
1.3.5 外设 30
1.3.5.1 不对称 PID Controller 外设 32
1.3.5.2 不连续外设地址范围 32
1.3.5.3 存储器速度 32
2 中断矩阵 (INTERRUPT) 33
2.1 概述 33
2.2 主要特性 33
2.3 功能描述 33
2.3.1 外部中断源 33
2.3.2 CPU 中断 36
2.3.3 分配外部中断源至 CPU 外部中断 36
2.3.4 屏蔽 CPU 的 NMI 类型中断 37
2.3.5 查询外部中断源当前的中断状态 37
3 复位和时钟 38
3.1 System 复位 38
3.1.1 概述 38
3.1.2 复位源 38
3.2 系统时钟 39
3.2.1 概述 39
3.2.2 时钟源 39
3.2.3 CPU 时钟 40
3.2.4 外设时钟 41
3.2.4.1 APB_CLK 源 41
3.2.4.2 REF_TICK 源 41
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3.2.4.3 LEDC_SCLK 源 42
3.2.4.4 APLL_SCLK 源 42
3.2.4.5 PLL_D2_CLK 源 42
3.2.4.6 时钟源注意事项 42
3.2.5 Wi-Fi BT 时钟 42
3.2.6 RTC 时钟 42
3.2.7 音频 PLL 42
4 IO_MUX 和 GPIO 交换矩阵 (GPIO, IO_MUX) 44
4.1 概述 44
4.2 通过 GPIO 交换矩阵的外设输入 45
4.2.1 概述 45
4.2.2 功能描述 45
4.2.3 简单 GPIO 输入 46
4.3 通过 GPIO 交换矩阵的外设输出 46
4.3.1 概述 46
4.3.2 功能描述 46
4.3.3 简单 GPIO 输出 47
4.4 IO_MUX 的直接 I/O 功能 48
4.4.1 概述 48
4.4.2 功能描述 48
4.5 RTC IO_MUX 的低功耗和模拟 I/O 功能 48
4.5.1 概述 48
4.5.2 功能描述 48
4.6 Light-sleep 模式管脚功能 48
4.7 Pad Hold 特性 49
4.8 I/O Pad 供电 49
4.8.1 VDD_SDIO 电源域 50
4.9 外设信号列表 50
4.10 IO_MUX Pad 列表 55
4.11 RTC_MUX 管脚清单 56
4.12 寄存器列表 57
4.12.1 GPIO 交换矩阵寄存器列表 57
4.12.2 IO MUX 寄存器列表 58
4.12.3 RTC IO MUX 寄存器列表 59
4.13 寄存器 61
4.13.1 GPIO 交换矩阵寄存器 61
4.13.2 IO MUX 寄存器 69
4.13.3 RTC IO MUX 寄存器 70
5 DPort 寄存器 82
5.1 概述 82
5.2 主要特性 82
5.3 功能描述 82
5.3.1 系统和存储器寄存器 82
5.3.2 复位和时钟寄存器 82
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5.3.3 中断矩阵寄存器 82
5.3.4 DMA 寄存器 82
5.3.5 MPU/MMU 寄存器 82
5.3.6 APP_CPU 控制器寄存器 82
5.3.7 外设时钟门控和复位 83
5.4 寄存器列表 84
5.5 寄存器 91
6 DMA 控制器 (DMA) 107
6.1 概述 107
6.2 特性 107
6.3 功能描述 107
6.3.1 DMA 引擎的架构 107
6.3.2 链表 108
6.4 UART DMA (UDMA) 控制器 108
6.5 SPI DMA 控制器 109
6.6 I2S DMA 控制器 110
7 SPI 控制器 (SPI) 111
7.1 概述 111
7.2 SPI 特征 111
7.3 GP-SPI 接口 112
7.3.1 GP-SPI 四线全双工模式 112
7.3.2 GP-SPI 四线半双工模式 113
7.3.3 GP-SPI 三线半双工模式 113
7.3.4 GP-SPI 数据缓存 114
7.4 GP-SPI 时钟控制 114
7.4.1 GP-SPI 时钟极性和时钟相位 114
7.4.2 GP-SPI 时序 115
7.5 并行 QSPI 接口 116
7.5.1 并行 QSPI 接口通信格式 116
7.6 GP-SPI 中断硬件 117
7.6.1 SPI 中断 117
7.6.2 DMA 中断 117
7.7 寄存器列表 118
7.8 寄存器 120
8 SDIO 从机控制器 141
8.1 概述 141
8.2 主要特性 141
8.3 功能描述 141
8.3.1 SDIO Slave 功能块图 141
8.3.2 SDIO 总线上的数据发送和接收 141
8.3.3 寄存器访问 142
8.3.4 DMA 142
8.3.5 包的发送和接收流程 143
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8.3.5.1 Slave 向 Host 发送包 143
8.3.5.2 Slave 从 Host 接收包 145
8.3.6 SDIO 总线时序 146
8.3.7 中断 147
8.3.7.1 Host 侧中断 147
8.3.7.2 Slave 侧中断 147
8.4 寄存器列表 148
8.5 SLC 寄存器 149
8.6 SLC Host 寄存器 158
8.7 HINF 寄存器 170
9 SD/MMC 主机控制器 171
9.1 概述 171
9.2 主要特性 171
9.3 SD/MMC 外部接口信号 171
9.4 功能描述 172
9.4.1 SD/MMC 架构 172
9.4.1.1 BIU 模块 173
9.4.1.2 CIU 模块 173
9.4.2 命令通路 173
9.4.3 数据通路 174
9.4.3.1 数据发送 174
9.4.3.2 数据接收 175
9.5 CIU 操作的软件限制 175
9.6 收发数据 RAM 176
9.6.1 发送 RAM 模块 176
9.6.2 接收 RAM 模块 176
9.7 链表环结构 176
9.8 链表结构 177
9.9 初始化 179
9.9.1 DMAC 初始化 179
9.9.2 DMAC 数据发送初始化 179
9.9.3 DMAC 数据接收初始化 180
9.10 时钟相位选择 180
9.11 中断 181
9.12 寄存器列表 181
9.13 寄存器 182
10 以太网 (MAC) 202
10.1 概述 202
10.2 EMAC_CORE 204
10.2.1 传输操作 204
10.2.1.1 发送流量控制 204
10.2.1.2 冲突期间的重新发送 205
10.2.2 接收操作 205
10.2.2.1 接收协议 205
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10.2.2.2 接收帧控制器 206
10.2.2.3 接收流量控制 206
10.2.2.4 接收多帧的操作处理 206
10.2.2.5 错误处理 206
10.2.2.6 接收状态字 206
10.3 MAC 中断控制器 207
10.4 MAC 地址的过滤 207
10.4.1 单播目标地址过滤 207
10.4.2 多播目标地址过滤 207
10.4.3 广播地址过滤 207
10.4.4 单播源地址过滤 207
10.4.5 反向过滤操作 207
10.4.6 好的发送帧与接收帧 209
10.5 EMAC_MTL（MAC 传输层） 209
10.6 PHY 接口 209
10.6.1 MII（介质独立接口） 209
10.6.1.1 MII 与 PHY 间的接口信号 210
10.6.1.2 MII 时钟 211
10.6.2 RMII（精简介质独立接口） 211
10.6.2.1 RMII 接口信号描述 212
10.6.2.2 RMII 时钟 212
10.6.3 Station Management Agent (SMA) 接口 213
10.6.4 RMII 接口时序要求 213
10.7 以太网 DMA 特性 214
10.8 链表描述符 214
10.8.1 发送描述符 214
10.8.2 接收描述符 218
10.9 寄存器列表 223
10.10 寄存器 224
11 I2C 控制器 (I2C) 259
11.1 概述 259
11.2 主要特性 259
11.3 I2C 功能描述 259
11.3.1 I2C 简介 259
11.3.2 I2C 架构 260
11.3.3 I2C 总线时序 261
11.3.4 I2C cmd 结构 261
11.3.5 I2C 主机写入从机 262
11.3.6 I2C 主机读取从机 266
11.3.7 中断 268
11.4 寄存器列表 268
11.5 寄存器 270
12 I2S 控制器 (I2S) 280
12.1 概述 280
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12.2 主要特性 281
12.3 I2S 模块时钟 282
12.4 I2S 模式 283
12.4.1 支持的音频标准 283
12.4.1.1 Philips 标准 283
12.4.1.2 MSB 对齐标准 283
12.4.1.3 PCM 标准 284
12.4.2 模块复位 284
12.4.3 FIFO 操作 284
12.4.4 发送数据 284
12.4.5 接收数据 286
12.4.6 I2S 主机/从机模式 287
12.4.7 I2S PDM 模式 288
12.5 Camera-LCD 控制器 289
12.5.1 LCD 主机发送模式 290
12.5.2 Camera 从机接收模式 290
12.5.3 ADC/DAC 模式 291
12.6 I2S 中断 292
12.6.1 FIFO 中断 292
12.6.2 DMA 中断 293
12.7 寄存器列表 293
12.8 寄存器 295
13 UART 控制器 (UART) 312
13.1 概述 312
13.2 主要特性 312
13.3 功能描述 312
13.3.1 UART 简介 312
13.3.2 UART 架构 313
13.3.3 UART RAM 314
13.3.4 波特率检测 314
13.3.5 UART 数据帧 315
13.3.6 流控 315
13.3.6.1 硬件流控 316
13.3.6.2 软件流控 316
13.3.7 UDMA 317
13.3.8 UART 中断 317
13.3.9 UHCI 中断 317
13.4 寄存器列表 318
13.4.1 UART 寄存器 318
13.4.2 UHCI 寄存器 319
13.5 寄存器 321
14 LED PWM 控制器 (LEDC) 348
14.1 概述 348
14.2 功能描述 348
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14.2.1 架构 348
14.2.2 分频器 349
14.2.3 通道 350
14.2.4 中断 351
14.3 寄存器列表 351
14.4 寄存器 354
15 红外遥控 (RMT) 363
15.1 概述 363
15.2 功能描述 363
15.2.1 RMT 架构 363
15.2.2 RMT RAM 364
15.2.3 时钟 364
15.2.4 发射器 364
15.2.5 接收器 365
15.2.6 中断 365
15.3 寄存器列表 365
15.4 寄存器 366
16 电机控制脉宽调制器 (PWM) 371
16.1 概述 371
16.2 主要特性 371
16.3 模块 373
16.3.1 模块概述 373
16.3.1.1 预分频器模块 373
16.3.1.2 定时器模块 373
16.3.1.3 操作器模块 374
16.3.1.4 故障检测模块 376
16.3.1.5 捕获模块 376
16.3.2 PWM 定时器模块 376
16.3.2.1 PWM 定时器模块的配置 376
16.3.2.2 PWM 定时器工作模式和定时事件生成 377
16.3.2.3 PWM 定时器影子寄存器 381
16.3.2.4 PWM 定时器同步和锁相 381
16.3.3 PWM 操作器模块 381
16.3.3.1 PWM 生成器模块 382
16.3.3.2 死区生成器模块 392
16.3.3.3 PWM 载波模块 396
16.3.3.4 故障处理器模块 399
16.3.4 捕获模块 400
16.3.4.1 介绍 400
16.3.4.2 捕获定时器 400
16.3.4.3 捕获通道 401
16.4 寄存器列表 401
16.5 寄存器 403
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17 脉冲计数器 (PCNT) 447
17.1 概述 447
17.2 功能描述 447
17.2.1 架构图 447
17.2.2 计数器通道输入信号 448
17.2.3 观察点 448
17.2.4 举例 448
17.2.5 溢出中断 449
17.3 寄存器列表 449
17.4 寄存器 451
18 定时器组 (TIMG) 456
18.1 概述 456
18.2 功能描述 456
18.2.1 16-bit 预分频器 456
18.2.2 64-bit 时基计数器 456
18.2.3 报警产生 457
18.2.4 MWDT 457
18.2.5 中断 457
18.3 寄存器列表 457
18.4 寄存器 459
19 看门狗定时器 (WDT) 466
19.1 概述 466
19.2 主要特性 466
19.3 功能描述 466
19.3.1 时钟 466
19.3.2 运行过程 466
19.3.3 写保护 467
19.3.4 Flash 启动保护 467
19.3.5 寄存器 467
20 eFuse 控制器 (eFuse) 468
20.1 概述 468
20.2 主要特性 468
20.3 功能描述 468
20.3.1 结构 468
20.3.1.1 系统参数 efuse_wr_disable 469
20.3.1.2 系统参数 efuse_rd_disable 469
20.3.1.3 系统参数 coding_scheme 470
20.3.1.4 系统参数 BLK3_part_reserve 471
20.3.2 烧写系统参数 471
20.3.3 软件读取系统参数 474
20.3.4 硬件模块使用系统参数 475
20.3.5 中断 475
20.4 寄存器列表 476
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20.5 寄存器 478
21 双线汽车接口 (TWAI) 489
21.1 概述 489
21.2 主要特性 489
21.3 功能性协议 489
21.3.1 TWAI 性能 489
21.3.2 TWAI 报文 490
21.3.2.1 数据帧和远程帧 491
21.3.2.2 错误帧和过载帧 493
21.3.2.3 帧间距 494
21.3.3 TWAI 错误 495
21.3.3.1 错误类型 495
21.3.3.2 错误状态 495
21.3.3.3 错误计数 495
21.3.4 TWAI 位时序 496
21.3.4.1 名义位 496
21.3.4.2 硬同步与再同步 497
21.4 结构概述 498
21.4.1 寄存器模块 498
21.4.2 位流处理器 499
21.4.3 错误管理逻辑 499
21.4.4 位时序逻辑 499
21.4.5 接收滤波器 499
21.4.6 接收 FIFO 499
21.5 功能描述 499
21.5.1 模式 499
21.5.1.1 复位模式 500
21.5.1.2 操作模式 500
21.5.2 位时序 500
21.5.3 中断管理 501
21.5.3.1 接收中断 (RXI) 501
21.5.3.2 发送中断 (TXI) 501
21.5.3.3 错误报警中断 (EWI) 501
21.5.3.4 数据溢出中断 (DOI) 502
21.5.3.5 被动错误中断 (TXI) 502
21.5.3.6 仲裁丢失中断 (ALI) 502
21.5.3.7 总线错误中断 (BEI) 502
21.5.4 发送缓冲器与接收缓冲器 502
21.5.4.1 缓冲器概述 502
21.5.4.2 帧信息 503
21.5.4.3 帧标识符 503
21.5.4.4 帧数据 504
21.5.5 接收 FIFO 和数据溢出 504
21.5.6 接收滤波器 505
21.5.6.1 单滤波模式 505
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21.5.6.2 双滤波模式 506
21.5.7 错误管理 506
21.5.7.1 错误报警限制 508
21.5.7.2 被动错误 508
21.5.7.3 离线状态与离线恢复 508
21.5.8 错误捕捉 508
21.5.9 仲裁丢失捕捉 509
21.6 寄存器列表 510
21.7 寄存器 511
22 AES 加速器 (AES) 523
22.1 概述 523
22.2 主要特性 523
22.3 功能描述 523
22.3.1 运算模式 523
22.3.2 密钥、明文、密文 523
22.3.3 字节序 523
22.3.4 加密与解密运算 526
22.3.5 运行效率 526
22.4 寄存器列表 526
22.5 寄存器 527
23 SHA 加速器 (SHA) 529
23.1 概述 529
23.2 主要特性 529
23.3 功能描述 529
23.3.1 填充解析信息 529
23.3.2 信息摘要 529
23.3.3 哈希运算 529
23.3.4 运行效率 530
23.4 寄存器列表 530
23.5 寄存器 532
24 RSA 加速器 (RSA) 537
24.1 概述 537
24.2 主要特性 537
24.3 功能描述 537
24.3.1 初始化 537
24.3.2 大数模幂运算 537
24.3.3 大数模乘运算 538
24.3.4 大数乘法运算 539
24.4 寄存器列表 540
24.5 寄存器 541
25 随机数发生器 (RNG) 543
25.1 概述 543
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25.2 主要特性 543
25.3 功能描述 543
25.4 编程指南 543
25.5 寄存器列表 544
25.6 寄存器 544
26 片外存储器加密与解密 (FLASH) 545
26.1 概述 545
26.2 主要特性 545
26.3 功能描述 545
26.3.1 Key Generator 模块 546
26.3.2 Flash Encryption 模块 546
26.3.3 Flash Decryption 模块 547
26.4 寄存器列表 547
26.5 寄存器 547
27 存储器管理和保护单元 (MMU, MPU) 549
27.1 概述 549
27.2 主要特性 549
27.3 功能描述 549
27.3.1 PID 控制器 549
27.3.2 MPU/MMU 549
27.3.2.1 嵌入式存储器 549
27.3.2.2 片外存储器 556
27.3.2.3 外设 561
28 PID 控制器 (PID) 563
28.1 概述 563
28.2 主要特性 563
28.3 功能描述 563
28.3.1 中断识别 563
28.3.2 信息记录 564
28.3.3 进程主动切换进程 566
28.4 寄存器列表 567
28.5 寄存器 569
29 片上传感器与模拟信号处理 573
29.1 概述 573
29.2 电容式触摸传感器 573
29.2.1 简介 573
29.2.2 主要特性 573
29.2.3 可用通用输入输出接口 574
29.2.4 功能描述 574
29.2.5 触发传感器的状态机 574
29.3 SAR ADC 576
29.3.1 简介 576
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29.3.2 主要特性 577
29.3.3 功能概况 577
29.3.4 RTC SAR ADC 控制器 579
29.3.5 DIG SAR ADC 控制器 579
29.4 霍尔传感器 581
29.4.1 简介 581
29.4.2 主要特性 581
29.4.3 功能描述 581
29.5 数字模拟转换器 582
29.5.1 简介 582
29.5.2 主要特性 582
29.5.3 结构 582
29.5.4 余弦波形生成器 583
29.5.5 支持 DMA 583
29.6 寄存器列表 584
29.6.1 传感器 584
29.6.2 外围总线 585
29.6.3 RTC I/O 585
29.7 寄存器 586
29.7.1 传感器 586
29.7.2 高级外围总线 595
29.7.3 RTC I/O 599
30 超低功耗协处理器 (ULP) 600
30.1 概述 600
30.2 主要特性 600
30.3 功能描述 601
30.4 指令集 601
30.4.1 ALU - 算数与逻辑运算 601
30.4.1.1 对寄存器数值的运算 602
30.4.1.2 对指令立即值的运算 602
30.4.1.3 对阶段计数器寄存器数值的运算 603
30.4.2 ST –存储数据至内存 604
30.4.3 LD –从内存加载数据 604
30.4.4 JUMP –跳转至绝对地址 605
30.4.5 JUMPR –跳转至相对地址（基于 R0 寄存器判断） 605
30.4.6 JUMPS –跳转至相对地址（基于阶段计数器寄存器判断） 606
30.4.7 HALT –结束程序 606
30.4.8 WAKE –唤醒芯片 606
30.4.9 SLEEP –设置硬件计时器的唤醒周期 607
30.4.10WAIT –等待若干个周期 607
30.4.11ADC –对 ADC 进行测量 607
30.4.12I2C_RD / I2C_WR –读 / 写 I²C 608
30.4.13REG_RD –从外围寄存器读取 608
30.4.14REG_WR –写入外围寄存器 609
30.5 ULP 协处理器程序的执行 609
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30.6 RTC_I2C 控制器 611
30.6.1 配置 RTC_I2C 611
30.6.2 使用 RTC_I2C 612
30.6.2.1 I2C_RD - 读取单个字节 612
30.6.2.2 I2C_WR - 写入单个字节 612
30.6.2.3 检测错误条件 613
30.6.2.4 连接 I²C 信号 613
30.7 寄存器列表 613
30.7.1 SENS_ULP 地址空间 613
30.7.2 RTC_I2C 地址空间 614
30.8 寄存器 614
30.8.1 SENS_ULP 地址空间 614
30.8.2 RTC_I2C 地址空间 617
31 低功耗管理 (RTC_CNTL) 623
31.1 概述 623
31.2 主要特性 623
31.3 功能描述 623
31.3.1 简介 624
31.3.2 数字内核调压器 624
31.3.3 低功耗调压器 624
31.3.4 Flash 调压器 625
31.3.5 欠压检测器 626
31.3.6 RTC 模块 626
31.3.7 低功耗时钟 627
31.3.8 电源门控的实现 629
31.3.9 预设功耗模式 630
31.3.10唤醒源 632
31.3.11RTC 计时器 632
31.3.12RTC Boot 632
31.4 寄存器列表 634
31.5 寄存器 636
词汇列表 660
外设相关词汇 660
寄存器相关词汇 660
修订历史 661
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1-1 地址映射 26
1-2 片上寄存器地址映射 27
1-3 具有 DMA 功能的模块 29
1-4 片外存储器地址映射 29
1-5 Cache memory 模式 30
1-6 外设地址映射 31
2-1 PRO_CPU、APP_CPU 外部中断配置寄存器、外部中断源中断状态寄存器、外部中断源 34
2-2 CPU 中断 36
3-1 PRO_CPU 和 APP_CPU 复位源 38
3-2 CPU_CLK 源 40
3-3 CPU_CLK 源 40
3-4 外设时钟用法 41
3-5 APB_CLK 源 41
3-6 REF_TICK 源 41
3-7 LEDC_SCLK 源 42
4-1 IO_MUX Light-sleep 管脚功能寄存器 48
4-2 GPIO 交换矩阵外设信号 50
4-3 IO_MUX Pad 列表 55
4-4 RTC_MUX 管脚清单 56
7-1 管脚功能信号与总线信号映射关系 111
7-2 从机命令描述 113
7-3 主机模式时钟极性和相位控制寄存器值 115
7-4 从机模式时钟极性和相位控制寄存器值 115
9-1 SD/MMC 管脚描述 172
9-2 DES0 链表描述 177
9-3 DES1 178
9-4 DES2 179
9-5 DES3 179
10-1 目标地址过滤 208
10-2 源地址过滤 208
10-3 接收数据时序要求 213
10-4 发送数据时序要求 214
10-5 发送描述符 0 (TDES0) 215
10-6 发送描述符 1 (TDES1) 217
10-7 发送描述符 2 (TDES2) 218
10-8 发送描述符 3 (TDES3) 218
10-9 发送描述符 6 (TDES6) 218
10-10 发送描述符 7 (TDES7) 218
10-11 接收描述符 0 (RDES0) 219
10-12 接收描述符 1 (RDES1) 220
10-13 接收描述符 2 (RDES2) 221
10-14 接收描述符 3 (RDES3) 221
10-15 接收描述符 4 (RDES4) 221
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10-16 接收描述符 6 (RDES6) 222
10-17 接收描述符 7 (RDES7) 223
11-1 SCL 频率配置 261
12-1 I2S 信号总线描述 281
12-2 寄存器配置 285
12-3 发送通道模式 285
12-4 接收数据写入 FIFO 模式和对应寄存器配置 286
12-5 4 种模式对应寄存器配置 287
12-6 过采样率配置 288
12-7 下采样配置 289
14-1 常用配置频率及精度 349
16-1 操作器模块的配置参数 375
16-2 PWM 生成器中的所有定时事件 383
16-3 PWM 定时器递增计数时，定时事件的优先级 383
16-4 PWM 定时器递减计数时，定时事件的优先级 384
16-5 控制死区时间生成器开关的寄存器 393
16-6 死区生成器的典型操作模式 394
20-1 系统参数 468
20-2 BLOCK1/2/3 编码 470
20-3 烧写寄存器 471
20-4 时序配置 473
20-5 软件读取寄存器 474
21-1 SFF 和 EFF 中的数据帧和远程帧 492
21-2 错误帧 493
21-3 过载帧 494
21-4 帧间距 494
21-5 名义位时序中包含的段 497
21-6 TWAI_CLOCK_DIVIDER_REG 的 bit 信息; TWAI 地址 0x18 500
21-7 TWAI_BUS_TIMING_1_REG 的 bit 信息; TWAI 地址 0x1c 500
21-8 SFF 与 EFF 的缓冲器布局 502
21-9 TX/RX 帧信息 (SFF/EFF)；TWAI 地址 0x40 503
21-10 TX/RX 标识符 1 (SFF); TWAI 地址 0x44 504
21-11 TX/RX 标识符 2 (SFF); TWAI 地址 0x48 504
21-12 TX/RX 标识符 1 (EFF); TWAI 地址 0x44 504
21-13 TX/RX 标识符 2 (EFF); TWAI 地址 0x48 504
21-14 TX/RX 标识符 3 (EFF); TWAI 地址 0x4c 504
21-15 TX/RX 标识符 4 (EFF); TWAI 地址 0x50 504
21-16 TWAI_ERR_CODE_CAP_REG 的 bit 信息; TWAI 地址 0x30 508
21-17 SEG.4 - SEG.0 的位信息 509
21-18 TWAI_ARB LOST CAP_REG 中的位信息; TWAI 地址 0x2c 510
22-1 运算模式 523
22-2 AES 文本字节序 524
22-3 AES-128 密钥字节序 525
22-4 AES-192 密钥字节序 525
22-5 AES-256 密钥字节序 525
27-1 片上存储器的 MPU 和 MMU 结构 550
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27-2 管理 RTC FAST Memory 的 MPU 550
27-3 管理 RTC SLOW Memory 的 MPU 550
27-4 管理片上 SRAM 0 和 SRAM2 剩余 128 KB 的 MMU 页模式 551
27-5 SRAM0 MMU 页边界地址 552
27-6 SRAM2 MMU 页边界地址 553
27-7 DPORT_DMMU_TABLEn_REG 和 DPORT_IMMU_TABLEn_REG 554
27-8 针对 DMA 的 MPU 设置 555
27-9 片外存储器的虚地址 556
27-10 PRO_CPU 的 MMU 配置项号 557
27-11 APP_CPU 的 MMU 配置项号 557
27-12 PRO_CPU 的 MMU 配置项号（特殊模式） 557
27-13 APP_CPU 的 MMU 配置项号（特殊模式） 558
27-14 片外 SRAM 的虚拟地址模式 559
27-15 片外 SRAM 的虚地址（正常模式） 559
27-16 片外 SRAM 的虚地址（低-高模式） 559
27-17 片外 SRAM 的虚地址（偶-奇模式） 560
27-18 片外 RAM 的 MMU 配置项号 560
27-19 管理外设的 MPU 561
27-20 DPORT_AHBLITE_MPU_TABLE_X_REG 562
28-1 中断向量入口地址 564
28-2 PIDCTRL_LEVEL_REG 564
28-3 PIDCTRL_FROM_n_REG 565
29-1 ESP32 电容式触摸传感器的管脚 574
29-2 SAR ADC 的信号输入 578
29-3 ESP32 的 SAR ADC 控制器 578
29-4 样式表寄存器的字段信息 580
29-5 I 型 DMA 数据格式 581
29-6 II 型 DMA 数据格式 581
30-1 对寄存器数值的 ALU 运算 602
30-2 对指令立即值的 ALU 运算 603
30-3 对阶段计数器寄存器的 ALU 运算 603
30-4 ADC 指令的输入信号 607
31-1 RTC 电源域 629
31-2 唤醒源 632
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1-1 系统结构 25
1-2 地址映射结构 25
1-3 Cache 系统框图 30
2-1 中断矩阵结构图 33
3-1 系统复位 38
3-2 系统时钟 39
4-1 IO_MUX、RTC IO_MUX 和 GPIO 交换矩阵结构框图 44
4-2 通过 IO_MUX、GPIO 交换矩阵的外设输入 45
4-3 通过 GPIO 交换矩阵输出信号 47
4-4 ESP32 I/O Pad 供电源（QFN 6*6，顶视图） 49
4-5 ESP32 I/O Pad 供电源（QFN 5*5，顶视图） 50
6-1 DMA 引擎的架构 107
6-2 链表结构图 108
6-3 UDMA 模式数据传输 109
6-4 SPI DMA 109
7-1 SPI 系统框图 111
7-2 SPI 四线全双工/半双工通信 112
7-3 SPI 数据缓存 114
7-4 GP-SPI 从机数据输出 116
7-5 并行 QSPI 接口 117
7-6 并行 QSPI 接口的通信模式 117
8-1 SDIO Slave 功能块图 141
8-2 SDIO 总线上数据传输 142
8-3 CMD53 内容 142
8-4 SDIO Slave DMA 链表结构 142
8-5 链表串 143
8-6 Slave 向 Host 发送包的流程 144
8-7 Slave 从 Host 接收包的流程 145
8-8 Slave CPU 挂载 buffer 的流程 146
8-9 采样时序图 146
8-10 输出时序图 147
9-1 SD/MMC 外设连接的拓扑结构 171
9-2 SD/MMC 外部接口信号 172
9-3 SD/MMC 基本架构 172
9-4 命令通路状态机 174
9-5 数据传输状态机 174
9-6 数据接收状态机 175
9-7 链表环结构 177
9-8 链表结构 177
9-9 时钟相位选择 180
10-1 Ethernet MAC 功能概述 202
10-2 Ethernet 功能框图 204
10-3 MII 接口 210
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10-4 MII 时钟 211
10-5 RMII 接口 212
10-6 RMII 时钟 213
10-7 接收数据时序图 213
10-8 发送数据时序图 214
10-9 发送描述符 214
10-10 接收链表结构 218
11-1 I2C Master 基本架构 260
11-2 I2C Slave 基本架构 260
11-3 I2C 时序图 261
11-4 I2C 命令寄存器结构 262
11-5 I2C Master 写 7-bit 地址 Slave 263
11-6 I2C Master 写 10-bit 地址 Slave 264
11-7 I2C Master 写 7-bit 地址 Slave 的 M 地址 RAM 264
11-8 I2C Master 分段写 7-bit 地址 Slave 265
11-9 I2C Master 读 7-bit 地址 Slave 266
11-10 I2C Master 读 10-bit 地址 Slave 266
11-11 I2C Master 从 7-bit 地址 Slave 的 M 地址读取 N 个数据 267
11-12 I2C Master 分段读 7-bit 地址 Slave 268
12-1 I2S 系统框图 280
12-2 I2S 时钟 282
12-3 Philips 标准 283
12-4 MSB 对齐标准 283
12-5 PCM 标准 284
12-6 发送 FIFO 数据模式 285
12-7 第一阶段接收数据 286
12-8 接收数据写入 FIFO 模式 287
12-9 PDM 发送模块 288
12-10 PDM 发送信号 289
12-11 PDM 接收信号 289
12-12 PDM 接收模块 289
12-13 LCD 主机发送模式 290
12-14 LCD 主机发送数据帧格式 1 290
12-15 LCD 主机发送数据帧格式 2 290
12-16 Camera 从机接收模式 291
12-17 I2S 的 ADC 接口 291
12-18 I2S 的 DAC 接口 292
12-19 I2S DAC 接口数据输入 292
13-1 UART 基本架构图 313
13-2 UART 共享 RAM 图 314
13-3 UART 数据帧结构 315
13-4 AT_CMD 字符格式 315
13-5 硬件流控图 316
14-1 LED_PWM 架构 348
14-2 LED_PWM 高速通道框图 348
14-3 LED_PWM 分频器 349
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14-4 LED_PWM 输出信号图 350
14-5 渐变占空比输出信号图 350
15-1 RMT 架构 363
15-2 数据结构 364
16-1 MCPWM 外设概览 371
16-2 预分频器模块 373
16-3 定时器模块 373
16-4 操作器模块 374
16-5 故障检测模块 376
16-6 捕获模块 376
16-7 递增计数模式波形 377
16-8 递减计数模式波形 378
16-9 递增递减循环模式波形，同步事件后递减 378
16-10 递增递减循环模式波形，同步事件后递增 378
16-11 递增模式中生成的 UTEP 和 UTEZ 379
16-12 递减模式中生成的 UTEP 和 UTEZ 380
16-13 递增递减模式中生成的 UTEP 和 UTEZ 381
16-14 PWM 操作器的子模块 382
16-15 递增递减模式下的对称波形 385
16-16 递增计数模式，单边不对称波形，PWMxA 和 PWMxB 独立调制–高电平 386
16-17 递增计数模式，脉冲位置不对称波形，PWMxA 独立调制 387
16-18 递增递减循环计数模式，双沿对称波形，在 PWMxA 和 PWMxB 上独立调制–高电平有效 388
16-19 递增递减循环计数模式，双沿对称波形，在 PWMxA 和 PWMxB 上独立调制–互补 389
16-20 NCI 在 PWMxA 输出上软件强制事件示例 390
16-21 CNTU 在 PWMxB 输出上软件强制事件示例 391
16-22 死区模块的开关拓扑 393
16-23 高电平有效互补 (AHC) 死区波形 394
16-24 低电平有效互补 (ALC) 死区波形 394
16-25 高电平有效 (AH) 死区波形 395
16-26 低电平有效 (AL) 死区波形 395
16-27 PWM 载波操作的波形示例 397
16-28 载波模块的第一个脉冲和之后持续的脉冲示例 398
16-29 PWM 载波模块中持续脉冲的 7 种占空比设置 399
17-1 PULSE_CNT 单元基本架构图 447
17-2 PULSE_CNT 递增计数图 449
17-3 PULSE_CNT 递减计数图 449
21-1 数据帧和远程帧中的位域 491
21-2 错误帧中的位域 493
21-3 过载帧中的位域 493
21-4 帧间距中的域 494
21-5 位时序构成 497
21-6 TWAI 概略图 498
21-7 接收滤波器 505
21-8 单滤波模式 506
21-9 双滤波模式 507
21-10 错误状态变化 507
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21-11 丢失仲裁的 bit 位置 510
25-1 噪声源 543
26-1 Flash 加解密模块架构 545
27-1 MMU 访问示例 551
28-1 中断嵌套 566
29-1 触摸传感器 573
29-2 触摸传感器的内部结构 574
29-3 触摸传感器的工作流程 575
29-4 FSM 的内部结构 576
29-5 SAR ADC 的概况 576
29-6 SAR ADC 的功能概况 577
29-7 RTC SAR ADC 的功能概况 579
29-8 DIG SAR ADC 控制器的概况 580
29-9 霍尔传感器的结构 582
29-10 DAC 的功能概况 583
29-11 余弦波形生成器的工作流程 584
30-1 ULP 协处理器基本架构 600
30-2 ULP 协处理器的指令格式 601
30-3 指令类型 - 对寄存器数值的 ALU 运算 602
30-4 指令类型 - 对指令立即值的 ALU 运算 602
30-5 指令类型 - 对阶段计数器寄存器的 ALU 运算 603
30-6 指令类型 - ST 604
30-7 指令类型 - LD 604
30-8 指令类型 - JUMP 605
30-9 指令类型 - JUMPR 605
30-10 指令类型 - JUMPS 606
30-11 指令类型 - HALT 606
30-12 指令类型 - WAKE 606
30-13 指令类型 - SLEEP 607
30-14 指令类型 - WAIT 607
30-15 指令类型 - ADC 607
30-16 指令类型 - I²C 608
30-17 指令类型 - REG_RD 608
30-18 指令类型 - REG_WR 609
30-19 ULP 协处理器程序框图 610
30-20 ULP 协处理器程序流控图 611
30-21 I2C 读操作 612
30-22 I²C 写操作 613
31-1 ESP32 功耗控制示意图 623
31-2 数字内核调压器 624
31-3 低功耗调压器 625
31-4 Flash 调压器 626
31-5 欠压检测器 626
31-6 RTC 结构图 627
31-7 RTC 低功耗时钟 628
31-8 数字低功耗时钟 628
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31-9 RTC 状态 629
31-10 功耗模式 631
31-11 ESP32 启动流程图 633