实例介绍
【实例截图】
【核心代码】
.
├── VCS_labs
│ ├── lab1
│ │ ├── parta
│ │ │ ├── Makefile
│ │ │ ├── add4.v
│ │ │ ├── add8.v
│ │ │ ├── adder8.fsdb
│ │ │ ├── adder_top
│ │ │ ├── adder_top.daidir
│ │ │ │ ├── _8443_archive_1.so
│ │ │ │ ├── binmap.sdb
│ │ │ │ ├── build_db
│ │ │ │ ├── cc
│ │ │ │ │ ├── cc_bcode.db
│ │ │ │ │ └── cc_dummy_file
│ │ │ │ ├── cgname.json
│ │ │ │ ├── covg_defs
│ │ │ │ ├── debug_dump
│ │ │ │ │ ├── HsimSigOptDb.sdb
│ │ │ │ │ ├── dumpcheck.db
│ │ │ │ │ ├── dve_debug.db.gz
│ │ │ │ │ ├── fsearch
│ │ │ │ │ │ ├── check_fsearch_db
│ │ │ │ │ │ ├── fsearch.stat
│ │ │ │ │ │ ├── idents_GJwlw8.xml.gz
│ │ │ │ │ │ └── idents_tapi.xml.gz
│ │ │ │ │ ├── src_files_verilog
│ │ │ │ │ ├── topmodules
│ │ │ │ │ └── vir.sdb
│ │ │ │ ├── eblklvl.db
│ │ │ │ ├── elabmoddb.sdb
│ │ │ │ ├── external_functions
│ │ │ │ ├── hslevel_callgraph.sdb
│ │ │ │ ├── hslevel_level.sdb
│ │ │ │ ├── hslevel_rtime_level.sdb
│ │ │ │ ├── nsparam.dat
│ │ │ │ ├── pcc.sdb
│ │ │ │ ├── pcxpxmr.dat
│ │ │ │ ├── prof.sdb
│ │ │ │ ├── rmapats.dat
│ │ │ │ ├── saifNetInfo.db
│ │ │ │ ├── simv.kdb
│ │ │ │ ├── stitch_nsparam.dat
│ │ │ │ ├── tt.sdb
│ │ │ │ ├── vcs_rebuild
│ │ │ │ ├── vcselab_master_hsim_elabout.db
│ │ │ │ ├── vcselab_misc_hsdef.db
│ │ │ │ ├── vcselab_misc_hsim_elab.db
│ │ │ │ ├── vcselab_misc_hsim_fegate.db
│ │ │ │ ├── vcselab_misc_hsim_lvl.db
│ │ │ │ ├── vcselab_misc_hsim_name.db
│ │ │ │ ├── vcselab_misc_hsim_uds.db
│ │ │ │ ├── vcselab_misc_midd.db
│ │ │ │ ├── vcselab_misc_mnmn.db
│ │ │ │ ├── vcselab_misc_partition.db
│ │ │ │ ├── vcselab_misc_vcselabref.db
│ │ │ │ └── vcselab_misc_vpdnodenums
│ │ │ ├── addertb.v
│ │ │ ├── compile.log
│ │ │ ├── csrc
│ │ │ │ ├── Makefile
│ │ │ │ ├── Makefile.hsopt
│ │ │ │ ├── SIM_l.o
│ │ │ │ ├── _vcs_pli_stub_.c
│ │ │ │ ├── _vcs_pli_stub_.o
│ │ │ │ ├── amcQwB.o
│ │ │ │ ├── archive.0
│ │ │ │ │ ├── _8443_archive_1.a
│ │ │ │ │ └── _8443_archive_1.a.info
│ │ │ │ ├── cgincr.sdb
│ │ │ │ ├── cginfo.json
│ │ │ │ ├── cgproc.8443.json
│ │ │ │ ├── diag
│ │ │ │ ├── filelist
│ │ │ │ ├── filelist.cu
│ │ │ │ ├── filelist.dpi
│ │ │ │ ├── filelist.hsopt
│ │ │ │ ├── filelist.hsopt.llvm2_0.objs
│ │ │ │ ├── filelist.hsopt.objs
│ │ │ │ ├── filelist.pli
│ │ │ │ ├── hsim
│ │ │ │ │ └── hsim.sdb
│ │ │ │ ├── import_dpic.h
│ │ │ │ ├── objs
│ │ │ │ │ └── amcQw_d.o
│ │ │ │ ├── product_timestamp
│ │ │ │ ├── rmapats.c
│ │ │ │ ├── rmapats.h
│ │ │ │ ├── rmapats.m
│ │ │ │ ├── rmapats.o
│ │ │ │ ├── rmapats_mop.o
│ │ │ │ ├── rmar.c
│ │ │ │ ├── rmar.h
│ │ │ │ ├── rmar.o
│ │ │ │ ├── rmar0.h
│ │ │ │ ├── rmar_llvm_0_0.o
│ │ │ │ └── rmar_llvm_0_1.o
│ │ │ ├── fa.v
│ │ │ ├── filelist
│ │ │ ├── novas.conf
│ │ │ ├── novas.rc
│ │ │ ├── novas_dump.log
│ │ │ ├── run.log
│ │ │ ├── ucli.key
│ │ │ ├── verdiLog
│ │ │ │ ├── ToNetlist.log
│ │ │ │ ├── compiler.log
│ │ │ │ ├── exe.log
│ │ │ │ ├── fsdb.log
│ │ │ │ ├── novas.log
│ │ │ │ ├── novas.rc
│ │ │ │ ├── novas_autosave.ses
│ │ │ │ ├── novas_autosave.ses.config
│ │ │ │ ├── novas_autosave.ses.png
│ │ │ │ ├── novas_autosave.ses.wave.0
│ │ │ │ ├── turbo.log
│ │ │ │ └── verdi.cmd
│ │ │ └── wave.sh
│ │ └── partb
│ │ ├── add8.v
│ │ └── addertb.v
│ ├── lab2
│ │ ├── parta
│ │ │ ├── add4.v
│ │ │ ├── add8.v
│ │ │ ├── adder.f
│ │ │ ├── addertb.v
│ │ │ └── fa.v
│ │ └── partb
│ │ ├── add4.v
│ │ ├── add8.v
│ │ ├── adder.f
│ │ ├── addertb.v
│ │ ├── fa.v
│ │ └── test.s
│ ├── lab3
│ │ ├── cleanup
│ │ ├── fifo.sva
│ │ ├── fifo.v
│ │ ├── fifo_tb.v
│ │ ├── run1.f
│ │ ├── run1sva.f
│ │ ├── run_debug
│ │ ├── run_debug_all
│ │ ├── run_debug_sva
│ │ ├── start_over
│ │ │ ├── fifo.v
│ │ │ ├── fifo_fix1
│ │ │ ├── fifo_tb.v
│ │ │ └── run1.f
│ │ └── vcdplus_trace.vpd
│ ├── lab5
│ │ ├── parta
│ │ │ ├── add4.v
│ │ │ ├── add8.v
│ │ │ ├── adder.f
│ │ │ ├── addertb.v
│ │ │ └── fa.v
│ │ └── partb
│ │ ├── adder.f
│ │ ├── adder.v
│ │ ├── addertb.v
│ │ └── reference.dump
│ ├── lab6
│ │ ├── parta
│ │ │ ├── CAM.v
│ │ │ ├── codec.f
│ │ │ ├── codec.v
│ │ │ ├── codectb.v
│ │ │ ├── fileio.o
│ │ │ ├── solution
│ │ │ │ ├── CAM1.v
│ │ │ │ └── CAM2.v
│ │ │ └── test
│ │ └── partb
│ │ ├── CAM2.v
│ │ ├── codec.f
│ │ ├── codec.v
│ │ ├── codectb.v
│ │ ├── fileio.o
│ │ └── test
│ ├── lab7
│ │ ├── fifo.f
│ │ ├── fifo32X8.sdf
│ │ ├── fifo32X8.v
│ │ ├── fifo32X8_gate.v
│ │ ├── fifo32X8tb.v
│ │ ├── fifo_cntrl.v
│ │ ├── fifo_gate.f
│ │ ├── fifo_mem.v
│ │ ├── fileio.o
│ │ └── ram16X8.v
│ ├── lab8
│ │ ├── CODE
│ │ │ ├── data1
│ │ │ ├── data2
│ │ │ ├── data3
│ │ │ ├── data4
│ │ │ ├── data5
│ │ │ ├── text1
│ │ │ ├── text2
│ │ │ ├── text3
│ │ │ ├── text4
│ │ │ └── text5
│ │ ├── clean
│ │ ├── data_segment
│ │ ├── design
│ │ │ ├── alu.v
│ │ │ ├── alu_control.v
│ │ │ ├── cpu.v
│ │ │ ├── decode.orig.v
│ │ │ ├── decode.v
│ │ │ ├── globals.v
│ │ │ ├── quick_compare.v
│ │ │ ├── regfile.v
│ │ │ ├── system.v
│ │ │ ├── testbench.v
│ │ │ └── wb_control.v
│ │ ├── files
│ │ ├── run_all
│ │ ├── run_base
│ │ ├── run_fsm
│ │ ├── run_line
│ │ └── text_segment
│ └── lib
│ ├── add4.v
│ ├── fa.v
│ ├── fileio2.0
│ │ ├── compare.pat
│ │ ├── compare.v
│ │ ├── data.bin
│ │ ├── data.c
│ │ ├── fileio.c
│ │ ├── fileio.o
│ │ ├── fileio.tab
│ │ ├── fileio_32.o
│ │ ├── fileio_task.tab
│ │ ├── load_mem.v
│ │ ├── read_pattern.pat
│ │ ├── read_pattern.v
│ │ ├── script.v
│ │ ├── strobe_compare.c
│ │ ├── strobe_compare.tab
│ │ └── veriuser.c
│ └── vendor_lib
│ └── core.v
└── VCS培训实验源码.zip
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