实例介绍
【实例简介】
用FPGA生成SPWM波形
可编程逻辑器件 B_ Address≤m; 15.0m8 250s fORms end if. el prooess(Div dk AA, BB, CC, input If Dn ckevent and diy ck= then DN ck为ck的 分频时钟 减Lu iAA= 1then;AA为A相查表控制位当为”时从 ROM仲中取正弦值, 图4礼=0.75 q<= a Address;q为ROM表对应正弦值的地 址入口 二 AD=<= AROM Dat为输入的调制深度, ROM Data为ROM正弦表的正弦值 PAs= A Data14dowm8除法运算,舍取最低 位实现 TUoJU esBB=ten;AA为A相查表控制位,当为“"时, 从ROM中取正弦值 图5λ=025 g=B Address; PB<=B Data (14 downto 8) B Data <=A ROM Data 路SPWM波形。可以看到,输出的六路PWM信号与图4相比,脉 elsif CC=1"ther 冲宽度有∫明显的改变。 t=C Address; PC<=C Data(14 downto B); C Data <=Ar 结束语 ROM Data end if end if 本文提出了一种利用FPGA生PWM波的方案,并给出了具 end process, 体的实现方法以及相应的PWM波发生框图。该电路通过系统可 process(alk, iagA) 编程芯片实现,用硬件描述语言以及图形输入完成了整个功能模 块的仝部设计工作,使得鮭发电路更加可靠和稳定,为高载波 if ckevent and clk1 SPWM波形生成提供了一条快速实现的途径。如果改变输入时钟 f fiag1then;fagA为A相同步信号控制位,agA=1表示 的频率以及相应的载波频率,以此电路为核心,配合相应的外部保 前A相正弦一一波处于正半周期 护电路与其它逻辑控制电路,完全可以应用于逆变系统中。【A A_Adμs<PA+"111111|期正弦调制波幅值请整 参考文献 elsif flagA= tothen;agA=表示当前A相正弦疲处于处于负半 [】许强,等.基于FPGA的三相PWM发生器[电子技术应 周期 用32001,27(1:73-74 A_ Adjust<"11114^‘负半周期调幅 [2]田杰,等.基于FPGA的静止补偿器PMM咏冲发生器设计 end if [.电力系统自动化,20,24(23:47~49 end f [3 Zbigniew Bielewicz, Leszek Debowski. A DSP and FPGA End process, Based Integrated Controller Development Solutions for High Performance Electric Drives. Proceedings of the IEEE interna 系统逻辑与时序功能仿真 tional Symposium on Industrial Electronics, Warsaw, Poland 利用MAX+PuS的波形仿真功能可以得到心片输入输出仿真 1996,2:679-684 图。Atea公司的这种软件非常方便的提供了验证方式。个但提供逻 [4]shih-Liang Jung, Meng-Yueh Chang Design and imple- 辑输出的验证,而且提洪∫时序的验证,包括芯片内部的各点之间的 mentation of a FPGA-Based Control IC for AC-Voltage Regula tion IEEE Transactions on Power Electronics, 1999, 14(3): 522 延时以及竞争冒险现象的出现。 532 图4为输入调制频率为50H、调制笨度为075时的三相六路 5]戴本祁.三相整流器移相触发电路的EDA设计电力电 SPMM陂形,三相被此相位互差120°。其中A与A为A相没有加死区 子技术,2000,34(3):53-54 的桥信号与下析信号,后面以此类推,1a9A1agB和假gC为三相正 [6侯波亨,等.ⅦHDL硬件描述浯言与数字逻辑电路设计M. 弦同步信号,以保证三相路数据严格接相互滞后120°的样位输出 西安电子科技大学出版社.1999 图5为输入调制颇率为50Hz、调制深度为025时的三相六 世界电子元器件2003.10 459 201994-2010ChinaAcademicJOurnalElectronicPublishingHouse.Allrightsreservedhttplwww.cnki.nct 【实例截图】
【核心代码】
用FPGA生成SPWM波形
可编程逻辑器件 B_ Address≤m; 15.0m8 250s fORms end if. el prooess(Div dk AA, BB, CC, input If Dn ckevent and diy ck= then DN ck为ck的 分频时钟 减Lu iAA= 1then;AA为A相查表控制位当为”时从 ROM仲中取正弦值, 图4礼=0.75 q<= a Address;q为ROM表对应正弦值的地 址入口 二 AD=<= AROM Dat为输入的调制深度, ROM Data为ROM正弦表的正弦值 PAs= A Data14dowm8除法运算,舍取最低 位实现 TUoJU esBB=ten;AA为A相查表控制位,当为“"时, 从ROM中取正弦值 图5λ=025 g=B Address; PB<=B Data (14 downto 8) B Data <=A ROM Data 路SPWM波形。可以看到,输出的六路PWM信号与图4相比,脉 elsif CC=1"ther 冲宽度有∫明显的改变。 t=C Address; PC<=C Data(14 downto B); C Data <=Ar 结束语 ROM Data end if end if 本文提出了一种利用FPGA生PWM波的方案,并给出了具 end process, 体的实现方法以及相应的PWM波发生框图。该电路通过系统可 process(alk, iagA) 编程芯片实现,用硬件描述语言以及图形输入完成了整个功能模 块的仝部设计工作,使得鮭发电路更加可靠和稳定,为高载波 if ckevent and clk1 SPWM波形生成提供了一条快速实现的途径。如果改变输入时钟 f fiag1then;fagA为A相同步信号控制位,agA=1表示 的频率以及相应的载波频率,以此电路为核心,配合相应的外部保 前A相正弦一一波处于正半周期 护电路与其它逻辑控制电路,完全可以应用于逆变系统中。【A A_Adμs<PA+"111111|期正弦调制波幅值请整 参考文献 elsif flagA= tothen;agA=表示当前A相正弦疲处于处于负半 [】许强,等.基于FPGA的三相PWM发生器[电子技术应 周期 用32001,27(1:73-74 A_ Adjust<"11114^‘负半周期调幅 [2]田杰,等.基于FPGA的静止补偿器PMM咏冲发生器设计 end if [.电力系统自动化,20,24(23:47~49 end f [3 Zbigniew Bielewicz, Leszek Debowski. A DSP and FPGA End process, Based Integrated Controller Development Solutions for High Performance Electric Drives. Proceedings of the IEEE interna 系统逻辑与时序功能仿真 tional Symposium on Industrial Electronics, Warsaw, Poland 利用MAX+PuS的波形仿真功能可以得到心片输入输出仿真 1996,2:679-684 图。Atea公司的这种软件非常方便的提供了验证方式。个但提供逻 [4]shih-Liang Jung, Meng-Yueh Chang Design and imple- 辑输出的验证,而且提洪∫时序的验证,包括芯片内部的各点之间的 mentation of a FPGA-Based Control IC for AC-Voltage Regula tion IEEE Transactions on Power Electronics, 1999, 14(3): 522 延时以及竞争冒险现象的出现。 532 图4为输入调制频率为50H、调制笨度为075时的三相六路 5]戴本祁.三相整流器移相触发电路的EDA设计电力电 SPMM陂形,三相被此相位互差120°。其中A与A为A相没有加死区 子技术,2000,34(3):53-54 的桥信号与下析信号,后面以此类推,1a9A1agB和假gC为三相正 [6侯波亨,等.ⅦHDL硬件描述浯言与数字逻辑电路设计M. 弦同步信号,以保证三相路数据严格接相互滞后120°的样位输出 西安电子科技大学出版社.1999 图5为输入调制颇率为50Hz、调制深度为025时的三相六 世界电子元器件2003.10 459 201994-2010ChinaAcademicJOurnalElectronicPublishingHouse.Allrightsreservedhttplwww.cnki.nct 【实例截图】
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